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参数资料
| 型号： | RJ80530LZ001512 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1000 MHz, MICROPROCESSOR, CPGA478 |
| 封装： | MICRO, FCPGA-478 |
| 文件页数： | 50/96页 |
| 文件大小： | 2018K |
| 代理商： | RJ80530LZ001512 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页当前第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
System Signal Simulations
R
54
Mobile Intel
Pentium III Processor-M Datasheet
Table 32. PICCLK DC Specifications and AC Signal Quality Specifications
Symbol
Parameter
Min Max Unit
Figure
Notes
V1
VIL20
0.4
V
20
Note 1
V2
VIH20
1.6
V
20
Note 1
V3
VIN Absolute Voltage Range
-0.5 2.4
V
20
Undershoot, Overshoot, Note 2
V4
PICCLK Rising Edge Ringback
1.6
V
20
Absolute Value, Note 3
V5
PICCLK Falling Edge Ringback
0.4
V
20
Absolute Value, Note 3
NOTES:
1.
The clock must rise/fall monotonically between VIL20 and VIH20.
2.
These specifications apply only when PICCLK is running. See the DC specifications for when PICCLK is
stopped. PICCLK may not be above VIH20,max or below VIL20,min for more than 50% of the clock cycle.
3.
The rising and falling edge ringback voltage specified is the minimum (rising) or maximum (falling) absolute
voltage the PICCLK signal can go to after passing the VIH20 (rising) or VIL20 (falling) voltage limits.
Figure 20. BCLK (Single Ended)/PICCLK Generic Clock Waveform
V0012-01
V1
V2
V3max
V4
V3min
V5
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PDF描述 |
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