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参数资料
| 型号： | RJ80530LZ001512 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1000 MHz, MICROPROCESSOR, CPGA478 |
| 封装： | MICRO, FCPGA-478 |
| 文件页数： | 47/96页 |
| 文件大小： | 2018K |
| 代理商： | RJ80530LZ001512 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页当前第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页
Electrical Specifications
R
Mobile Intel
Pentium III Processor-M Datasheet
51
Figure 17. Quick Start/Deep Sleep Timing (BCLK Stopping Method)
T
w
stpgnt
Stopped
BCLK
STPCLK#
CPU bus
DPSLP#
Compatibility
Signals
Changing
Normal
Quick Start
Deep Sleep
Quick Start
Normal
Frozen
T
v
T
y
T
z
T
x
V00102-00
NOTES:
Tv=T45 (Stop Grant Acknowledge Bus Cycle Completion to Clock Shut Off Delay)
Tw=T46 (Setup Time to Input Signal Hold Requirement)
Tx=T47 (Deep Sleep PLL Lock Latency)
Ty=T48 (PLL lock to STPCLK# Hold Time)
Tz=T49 (Input Signal Hold Time)
Figure 18. Quick Start/Deep Sleep Timing (DPSLP# Assertion Method)
T
w
stpgnt
BCLK
STPCLK#
CPU bus
DPSLP#
Compatibility
Signals
Changing
Normal
Quick Start
Deep Sleep
Quick Start
Normal
Frozen
T
v
T
y
T
z
T
x
V00103-00
NOTES:
Tv=T45 (Stop Grant Acknowledge Bus Cycle Completion to DPSLP# assertion)
Tw=T46 (Setup Time to Input Signal Hold Requirement)
Tx=T47 (Deep Sleep PLL Lock Latency)
Ty=T48 (PLL lock to STPCLK# Hold Time)
Tz=T49 (Input Signal Hold Time)
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PDF描述 |
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参数描述 |
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