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参数资料
| 型号： | WJLXT384LEB1 |
| 厂商： | CORTINA SYSTEMS INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP144 |
| 封装： | 20 X 20MM, ROHS COMPLIANT, LQFP-144 |
| 文件页数： | 124/140页 |
| 文件大小： | 1514K |
| 代理商： | WJLXT384LEB1 |
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84
Document Number: 248994
Revision Number: 005
Revision Date: November 28, 2005
Intel LXT384 Octal T1/E1/J1 S/H PCM Transceiver with JA
Table 44. Pulse Shaping Indirect Address Register, PSIAD (10h)
Bit1
Name
Function
0-2
LENAD 0-2
The three bit value written to these bits determine the channel to be addressed. Data
can be read from (written to) the Pulse Shaping Data Register (PSDAT).
LENAD 0-2
Channel
LENAD 0-2
Channel
0h
0
4h
4
1h
1
5h
5
2h
2
6h
6
3h
3
7h
7
3 - 7
-
Reserved.
1. On power-on reset the register is set to “0”.
Table 45. Pulse Shaping Data Register, PSDAT (11h) for Intel
LXT384 Transceiver
Bit
Name
Function
0-2
LEN 0-2
1
LEN0-2 determine the operation mode of the LXT384 Transceiver: T1 or E1. In
addition, for T1 operation, LEN2-0 set the pulse shaping to meet the T1.102 pulse
template at the DSX-1 cross-connect point for various cable lengths:
LEN2
LEN1
LEN0
Line Length
Cable Loss2
Operation
Mode
0
1
0
1
0
1
0
1
0 - 133 ft. ABAM
133 - 266 ft. ABAM
266 - 399 ft. ABAM
399 - 533 ft. ABAM
533 - 655 ft. ABAM
0.6 dB
1.2 dB
1.8 dB
2.4 dB
3.0 dB
T1
0
E1 G.703, 75
Ω coaxial cable and 120Ω
twisted pair cable.
E1
3 - 7
-
Reserved.
1. On power-on reset the register is set to “0”.
2. Maximum cable loss at 772 KHz.
3. When reading LEN, bit values appear inverted.
Table 46. Output Enable Register, OER - 12h
Bit
Name
Description
R/W
7:0
OE7:0
Output Enable.
On power-up, all OE7:0 bits are cleared to ‘0’.
When an OE bit is set to ‘1’, the output driver of its corresponding
transmitter goes into a high-impedance tristate.
R/W
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