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参数资料
| 型号： | 865G |
| 厂商： | Intel Corp. |
| 英文描述： | Intel 865G/865GV Graphics and Memory Controller Hub |
| 中文描述： | 英特尔865G/865GV图形和内存控制器中枢 |
| 文件页数： | 128/249页 |
| 文件大小： | 3540K |
| 代理商： | 865G |
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Intel
82865G/82865GV GMCH Datasheet
129
Register Description
3.9.4
PCISTS6—PCI Status Register (Device 6)
Address Offset:
Default Value:
Access:
Size:
06–07h
0080h
RO
16 bits
PCISTS6 is a 16-bit status register that reports the occurrence of error events on Device 6, Function
0’s PCI interface. Since GMCH Device 6 does not physically reside on PCI_0, many of the bits are
not implemented.
3.9.5
RID6—Revision Identification Register (Device 6)
Address Offset:
Default Value:
Access:
Size:
08h
See table below
RO
8 bits
This register contains the revision number of the GMCH Device 0.
Bit
Descriptions
15
Detected Parity Error (DPE)—RO.
Hardwired to 0.
14
Signaled System Error (SSE)—RO.
Hardwired to 0.
13
Received Master Abort Status (RMAS)—RO.
Hardwired to 0.
12
Received Target Abort Status (RTAS)—RO.
Hardwired to 0.
11
Signaled Target Abort Status (STAS)—RO.
Hardwired to 0.
10:9
DEVSEL Timing (DEVT)—RO.
Hardwired to 00b. Device 6 does not physically connect to PCI_A.
These bits are set to 00b (fast decode) so that optimum DEVSEL timing for PCI_A is not limited by
the GMCH.
8
Master Data Parity Error Detected (DPD)—RO.
Hardwired to 0.
7
Fast Back-to-Back (FB2B)—RO.
Hardwired to 1. This indicates fast back-to-back capability;
thus, the optimum setting for PCI_A is not limited by the GMCH.
6:0
Reserved.
Bit
Descriptions
7:0
Revision Identification Number (RID)—RO.
This is an 8-bit value that indicates the revision
identification number for the GMCH Device 6. This value is the same as the RID register.
02h = A-2 Stepping
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