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参数资料
| 型号： | ADE7569ASTZF16 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 119/136页 |
| 文件大小： | 0K |
| 描述： | IC ENERGY METER MCU 16K 64LQFP |
| 标准包装： | 1 |
| 输入阻抗： | * |
| 测量误差： | * |
| 电压 - 高输入/输出： | * |
| 电压 - 低输入/输出： | * |
| 电流 - 电源： | * |
| 电源电压： | * |
| 测量仪表类型： | * |
| 工作温度： | * |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-LQFP（10x10） |
| 包装： | 托盘 |
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Preliminary Technical Data
SERIAL PERIPHERAL INTERFACE (SPI)
The ADE7566/ADE7569 integrate a complete hardware serial
peripheral interface on-chip. The SPI is full duplex so that 8 bits
of data are synchronously transmitted and simultaneously
received. This SPI implementation is double buffered, allowing
users to read the last byte of received data while a new byte is
shifted in. The next byte to be transmitted can be loaded while
the current byte is shifted out.
The SPI port can be configured for master or slave operation.
The physical interface to the SPI is via MISO (P0.5), MOSI (P0.4),
SCLK (P0.6), and SS (P0.7) pins, while the firmware interface is
SPI SFR REGISTER LIST
Table 133. SPI SFR Register List
ADE7566/ADE7569
via the SPI Configuration Register SFR (SPIMOD1, 0xE8), the
SPI Configuration Register SFR (SPIMOD2, 0xE9), the SPI
Interrupt Status Register SFR (SPISTAT, 0xEA), the SPI/I 2 C
Transmit Buffer SFR (SPI2CTx, 0x9A), and the SPI/I 2 C Receive
Buffer SFR (SPI2CRx, 0x9B).
Note that the SPI pins are shared with the I 2 C pins. Therefore, the
user can enable only one interface at a time. The SCPS bit in the
Configuration SFR (CFG, 0xAF) selects which peripheral is
active.
SFR Address
0x9A
0x9B
0xE8
0xE9
0xEA
Name
SPI2CTx
SPI2CRx
SPIMOD1
SPIMOD2
SPISTAT
R/W
W
R
R/W
R/W
R/W
Length
8
8
8
8
8
Default
0
0x10
0
0
Description
SPI/I 2 C Data Out Register (see Table 134).
SPI/I 2 C Data in Register (see Table 135).
SPI Configuration Register (see Table 136).
SPI Configuration Register. (see Table 137).
SPI/I 2 C Interrupt Status Register (see Table 138).
Table 134. SPI/I 2 C Transmit Buffer SFR (SPI2CTx, 0x9A)
Bit No.
7 to 0
Mnemonic
SPI2CTx
Default
0
Description
SPI or I 2 C Transmit Buffer. When SPI2CTx SFR is written, its content is transferred to the transmit FIFO
input. When a write is requested, the FIFO output is sent on the SPI or I 2 C bus.
Table 135. SPI/I 2 C Receive Buffer SFR (SPI2CRx, 0x9B)
Bit No.
7 to 0
Mnemonic
SPI2CRx
Default
0
Description
SPI or I 2 C Receive Buffer. When SPI2CRx SFR is read, one byte from the receive FIFO output is transferred
to SPI2CRx SFR. A new data byte from the SPI or I 2 C bus is written to the FIFO input.
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