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参数资料
| 型号： | PC87393F-VJG |
| 厂商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分类： | 外设及接口 |
| 英文描述： | 100-Pin LPC SuperI/O Devices for Portable Applications |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 23/148页 |
| 文件大小： | 1733K |
| 代理商： | PC87393F-VJG |
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7.0 X-Bus Extension (Continued)
119
www.national.com
XA3-0
HA3-0
XD7-0
HA11-4
XA18-12
HA18-12
XSTB0
FXASTB
XRDY
HIOCHRDY
PIRQA-D
IRQ11, IRQ8, IRQ12, and IRQ1 respectively
GND
HMEMCS
If any of the functions multiplexed on XA18-12 (Game Port or Serial Port 2) are needed, use an external latch for these
signals.
Use the XRDY signal that is enabled upon reset. Either of the XIORD and XIOWR signals may be used. Set proper sys-
tem configuration before accessing a PC87570 or any I/O device with separate read and write signals for I/O and mem-
ory transactions.
2. Bear in mind the following system design hints for asynchronous X-Bus use:
q
The chip select signal should be used as a qualier with the address when partial address decoding is in use for mul-
tiple device access control.
q
In read cycles, the system may drive the data until the read signal XRD is de-asserted to guarantee the proper
PC8739x sampling.
q
In write cycles, use either the falling or rising edge of the write control signal (XWR) to latch the data in the device.
3. Address multiplexing on XDT7-0 and the XSTB2-0 is designed for glueless interface with off-chip latch components. See
the example using 74HCT373 latches in Figure 29.
Figure 29. Latched Mode X-Bus Transactions External Logic
(74HCT373)
D7-0
A27-20
A19-12
A3-0
XA3-0
XDT7-0
A11-4
Latch
(74HCT373)
Latch
(74HCT373)
Latch
XSTB0
XSTB1
XSTB2
PC8739
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PDF描述 |
|---|---|
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| PCA.1D.694.CNAD42Z | CABLE TERMINATED, FEMALE, RF CONNECTOR, SOCKET |
| PCA.1D.694.CNAD42 | CABLE TERMINATED, FEMALE, RF CONNECTOR, SOCKET |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| PC87393VJG | 制造商:Texas Instruments 功能描述: 制造商:Texas Instruments 功能描述:IC, SUPER I/O DEVICE, TQFP-100, Logic Device Type:Buffer, Supply Voltage Min:3V, |
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