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参数资料
| 型号： | PC87393F-VJG |
| 厂商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分类： | 外设及接口 |
| 英文描述： | 100-Pin LPC SuperI/O Devices for Portable Applications |
| 中文描述： | MULTIFUNCTION PERIPHERAL, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 47/148页 |
| 文件大小： | 1733K |
| 代理商： | PC87393F-VJG |
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9.0 Device Characteristics (Continued)
140
www.national.com
9.4.3
LCLK and LRESET
Symbol
Parameter
Min
Max
Units
tCYC
1
1. The PCI may have any clock frequency between nominal DC and 33
MHz. Device operational parameters at frequencies under 16 MHz
may be guaranteed by design rather than by testing. The clock fre-
quency may be changed at any time during the operation of the sys-
tem as long as the clock edges remain “clean” (monotonic) and the
minimum cycle and high and low times are not violated. The clock
may only be stopped in a low state.
LCLK Cycle Time
30
ns
tHIGH
LCLK High Time
11
ns
tLOW
LCLK Low Time
11
ns
-
LCLK Slew Rate2
2. Rise and fall times are specied in terms of the edge rate measured in
V/ns. This slew rate must be met across the minimum peak-to-peak
portion of the clock wavering as shown below.
1
4
V/ns
-
LRESET Slew Rate3
3. The minimum LRESET slew rate applies only to the rising (de-assertion)
edge of the reset signal, and ensures that system noise cannot ren-
der an otherwise a monotonic signal to appear to bounce in the
switching range.
50
mV/ns
0.6 VDD
0.2 VDD
0.5 VDD
0.4 VDD
0.3 VDD
0.4 VDD p-to-p
(minimum)
tHIGH
tLOW
3.3 V Clock
tCYC
相关PDF资料 |
PDF描述 |
|---|---|
| PC906N | 896 MHz - 940 MHz YAGI ANTENNA, 10.65 dBi GAIN, 65 deg 3dB BEAMWIDTH |
| PC926N | 928 MHz - 960 MHz YAGI ANTENNA, 10.65 dBi GAIN, 65 deg 3dB BEAMWIDTH |
| PCA.1D.694.CNAD42Z | CABLE TERMINATED, FEMALE, RF CONNECTOR, SOCKET |
| PCA.1D.694.CNAD42 | CABLE TERMINATED, FEMALE, RF CONNECTOR, SOCKET |
| PCA.1D.694.CNAD52Z | CABLE TERMINATED, FEMALE, RF CONNECTOR, SOCKET |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PC87393VJG | 制造商:Texas Instruments 功能描述: 制造商:Texas Instruments 功能描述:IC, SUPER I/O DEVICE, TQFP-100, Logic Device Type:Buffer, Supply Voltage Min:3V, |
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