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参数资料
| 型号： | RN80532KC0412M |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2000 MHz, MICROPROCESSOR, CPGA603 |
| 封装： | Interposer, Micro, PGA-603 |
| 文件页数： | 39/132页 |
| 文件大小： | 2316K |
| 代理商： | RN80532KC0412M |
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Introduction
1-4
Intel Xeon Processor MP with up to 2MB L3 Cache
Retention mechanism - The support components that are mounted through the baseboard to
the chassis to provide mechanical retention for the processor and heatsink assembly.
Scratch EEPROM (Electrically Erasable, Programmable Read-Only Memory) - A
memory device located on the Intel Xeon processor MP with up to 2-MB L3 cache processor
and the Intel Xeon processor in INT-mPGA package, addressable via the SMBus which can be
used by the OEM to store information (e.g., information for system management, etc). See
Section 6.4 for details on the Scratch EEPROM.
SMBus - System Management Bus. A two-wire interface through which simple system and
power management related devices can communicate with the rest of the system. It is based on
the principals of the operation of the I2C two-wire serial bus from Philips Semiconductor.
1.2
References
Material and concepts available in the following documents may be beneficial when reading this
document.
NOTES:.
1. Available electronically on the Intel Developer public website http://developer.intel.com
2. Available electronically on the www.sbs-forum.org/smbus.
§
Document
Number/Location
AP-485, Intel Processor Identification and the CPUID Instruction
241618
IA-32 Intel Architecture Software Developer's Manual
1. Volume I: Basic Architecture
2. Volume II: Instruction Set Reference
3. Volume III: System Programming Guide
245470
245471
245472
CK00 Clock Synthesizer/Driver Design Guidelines
249206
VRM 9.1 DC-DC Converter Design Guidelines
298646
Intel Xeon Processor Multiprocessor Platform Design Guide
250397
Intel Xeon Processor (MP) Thermal Design Guidelines
298650
603 -Pin Socket Design Guidelines
249672
Intel Xeon Processor MP Family Enabled Components ProE* Files
http://developer.intel.com
Intel Xeon Processor MP Family Enabled Components IGES Files
http://developer.intel.com
Intel Xeon Processor MP with 512-KB L2 Cache Core Boundary Scan
Descriptor Language (BSDL) Model (V1.1) and Cell Descriptor File (V1.0)
http://developer.intel.com
ITP 700 Debug Port Design Guide
249679
System Management Bus Specification, rev 1.1
www.sbs-forum.org/smbus
Wired for Management 2.0 Design Guide
http://developer.intel.com
相关PDF资料 |
PDF描述 |
|---|---|
| RN80532KC041512 | 32-BIT, 2000 MHz, MICROPROCESSOR, CPGA603 |
| RP0352 | GRAPHICS PROCESSOR, PQFP80 |
| RP65C02G-06 | 8-BIT, 6 MHz, MICROPROCESSOR, PDIP40 |
| RPIXP2800BC | 32-BIT, 650 MHz, RISC PROCESSOR, PBGA1356 |
| RPIXP2850BB | 32-BIT, 1400 MHz, RISC PROCESSOR, PBGA1356 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| RN80532KC041512 | 制造商:Intel 功能描述:TRAY XEON 2.0GHZ 400MZH FSB - Trays 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| RN80532KC041512 SL5Z9 | 制造商:Intel 功能描述:MPU XEON 0.13UM 2GHZ 603-PIN UFCBGA - Trays |
| RN80532KC041512 SL6EM | 制造商:Intel 功能描述:MPU XEON 0.13UM 2GHZ 603-PIN UFCBGA - Trays |
| RN80532KC041512S L5Z9 | 制造商:Intel 功能描述:MPU Xeon? Processor 0.13um 2GHz 603-Pin uFCBGA |
| RN80532KC041512S L6W6 | 制造商:Intel 功能描述:MPU Xeon? Processor 0.13um 2GHz 603-Pin uFCBGA |
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