参数资料
| 型号： | XRT79L71IB-F |
| 厂商： | Exar Corporation |
| 文件页数： | 80/609页 |
| 文件大小： | 0K |
| 描述： | IC LIU/FRAMER DS3/E3 1CH 208BGA |
| 标准包装： | 126 |
| 控制器类型： | DS3/E3 调帧器 |
| 接口： | LIU |
| 电源电压： | 3.15 V ~ 3.45 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 208-LBGA |
| 供应商设备封装： | 208-STBGA（17x17） |
| 包装： | 托盘 |
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XRT79L71
PRELIMINARY
155
1-CHANNEL DS3/E3 CLEAR-CHANNEL FRAMERLIU COMBO - CC/HDLC ARCHITECTURE
REV. P2.0.0
The Transmit Line Driver Block
The Transmit Drive Monitor Block
4.2.6.1
The B3ZS Encoder Block
The purpose of the B3ZS Encoder block is to encode the outbound DS3 traffic into the B3ZS Line Code. In the
case of the XRT79L71, the B3ZS Encoder block will always be enabled, and the user has no ability to disable
the B3ZS Encoder block.
4.2.6.2
The Jitter Attenuator Block
The XRT79L71 includes a Jitter Attenuator block that can be configured to operate in either the Transmit
Direction (e.g., within the Transmit DS3/E3 LIU Block) or in the Receive Direction (e.g., within the Receive
DS3/E3 LIU Block). The purpose of the Jitter Attenuator block is to permit the XRT79L71 to comply with all of
the following Jitter Transfer Characteristic requirements.
Bellcore GR-499-CORE Category II to Category II Interfaces (DS3 Applications)
TBR-24 34Mbps D34U and D34S System Requirements (for E3 Applications)
Each of these requirements, and how the XRT79L71 performs against these requirements is described in
detail below.
4.2.6.2.1
The Basic Architecture of the Jitter Attenuator Block
Figure 69 presents an illustration of the Functional Block Diagram of the Jitter Attenuator Block
According to Figure 69 the Jitter Attenuator consists of the following functional blocks.
The Timing Control/Phase-Locked Loop Block
FIGURE 69. AN ILLUSTRATION OF THE FUNCTIONAL BLOCK DIAGRAM OF THE JITTER ATTENUATOR BLOCK
Timing Control
Block/
Phase Locked
Loop
Timing Control
Block/
Phase Locked
Loop
In_POS
In_NEG
In_CLK
Write_Clock
Read_Clock
Out_POS
Out_NEG
Out_CLK
Microprocessor
Interface
16/32 Bit FIFO
Jittery Clock
Smoothed Clock
FL
DS3Clk/E3Clk
Or SFM-Derived
Line Code
JA_RESET
相关PDF资料 |
PDF描述 |
|---|---|
| XRT81L27IV-F | IC LIU EI 7CH 3.3V 128TQFP |
| XRT82D20IW-F | IC LIU E1 SGL 28SOJ |
| XRT82L24AIV-F | IC LIU E1 QAUD 100TQFP |
| XRT83D10IW | IC LIU T1/E1 SGL 28SOJ |
| XRT83L30IV-F | IC LIU LH/SH T1/E1 SGL 64TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| XRT79L72 | 制造商:EXAR 制造商全称:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L72IB | 制造商:EXAR 制造商全称:EXAR 功能描述:2 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73 | 制造商:EXAR 制造商全称:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L73IB | 制造商:EXAR 制造商全称:EXAR 功能描述:3 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| XRT79L74 | 制造商:EXAR 制造商全称:EXAR 功能描述:4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
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