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参数资料
| 型号： | HSP50216KIZ |
| 厂商： | Intersil |
| 文件页数： | 26/58页 |
| 文件大小： | 0K |
| 描述： | IC DOWNCONVERTER DGTL 4CH 196BGA |
| 标准包装： | 1 |
| 功能： | 降频器 |
| RF 型： | W-CDMA |
| 封装/外壳： | 196-LFBGA |
| 包装： | 托盘 |
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HSP50216
TABLE 2. MAG/PHASE ACCURACY vs CLOCK CYCLES
MAGNITUDE
ERROR
PHASE
ERROR
PHASE
ERROR
CLOCKS
6
7
8
9
10
11
12
13
14
15
16
17
(% f S )
0.065
0.016
0.004
<0.004
<0.004
<0.004
<0.004
<0.004
<0.004
<0.004
<0.004
<0.004
(DEG.) ?
3.5
1.8
0.9
0.45
0.22
0.11
0.056
0.028
0.014
0.007
0.0035
0.00175
(% f S )
2
1
0.5
0.25
0.12
0.062
0.03
0.016
0.008
0.004
0.002
0.001
? Assumes ± 180° = f S .
The enable signal for gating data into the coordinate
converter is either the AGC data ready signal or the
resampler data ready signal. If the resampler is bypassed,
the AGC data ready signal is used and there is a delay of 6
clock cycles between the FIR data being ready and the
coordinate converter block sampling it. If the resampler is
enabled, its data ready signal will be delayed by 6 clocks (for
the AGC) plus the compute delay of the resampler block.
This may cause the I/Q to |r|/ θ output sample alignment to
shift with the decimation. For this reason, it is recommended
that the resampler/halfband filter block be bypassed when
using this new data path.
26
FN4557.6
August 17, 2007
相关PDF资料 |
PDF描述 |
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参数描述 |
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