参数资料
| 型号： | IP-FIR |
| 厂商： | Altera |
| 文件页数： | 53/76页 |
| 文件大小： | 0K |
| 描述： | IP FIR COMPILER |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | 有限脉冲响应编译器 |
| 许可证： | 初始许可证 |
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Chapter 4: Functional Description
FIR Compiler
Figure 4–10. Decimation Filter Structure
4–11
input
input
LPF
N
output
N Channel
P(0)
output
input
N Coefficient Set
Accumulator
output
Single Rate FIR Filter
P(1)
Control
Circuitry
P(2)
P(N-1)
Availability of Interpolation and Decimation Filters
Interpolation and decimation filters are available for all architectures:
■
■
■
■
Parallel distributed arithmetic
Serial distributed arithmetic
Multibit serial distributed arithmetic
Multicycle variable structures
All architecture configuration options are available for interpolation and decimation
filters, including:
■
■
■
■
User configuration of data storage type (memory or logic cells)
User configuration of coefficient storage type (memory or logic cells)
Multichannel capability
Multiple coefficient set capability
Family-Specific Features
Stratix IV, Stratix III and Stratix II filters implement ternary adder structures in all
architectures:
■
■
■
■
Fully parallel distributed arithmetic
Fully serial distributed arithmetic
Multibit serial distributed arithmetic
Multicycle variable
? May 2011
Altera Corporation
相关PDF资料 |
PDF描述 |
|---|---|
| IP-NCO | IP NCO COMPILER |
| IP-NIOS | IP NIOS II MEGACORE |
| IP-PCI/MT64 | IP PCI 64BIT MASTER/TARGET |
| IP-PCIE/8 | IP PCI EXPRESS, X8 |
| IP-POSPHY4 | IP POS-PHY L4 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| IP-FIRII | 功能描述:开发软件 FIR Compiler II MegaCore RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPFLBPT2 | 制造商:Carlo Gavazzi 功能描述:IL 35MM MUSH P-P PL 22MM RED |
| IPG1-0-90 | 制造商:Sensata Technologies 功能描述:1 Pole |
| IPG1-1-41-203-90 | 制造商:Sensata Technologies 功能描述:1 Pole |
| IPG1-1-51-103-A-00-V | 制造商:Sensata Technologies 功能描述:Circuit Breaker Magnetic 1Pole 10A 65VDC |
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