参数资料
| 型号： | IP-SRAM/QDRII |
| 厂商： | Altera |
| 文件页数： | 43/68页 |
| 文件大小： | 0K |
| 描述： | IP QDRII SRAM CONTROLLER |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | QDRII SRAM 控制器 |
| 许可证： | 初始许可证 |
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Functional Description
■
■
Writes
Reads
f
■ Simultaneous Read & Write Timing
For more information on the Avalon interface, refer to the Avalon
Interface Specifications .
Writes
■
■
■
“Bursts” on page 3–13
“Bursts with Pauses” on page 3–14
If the address is the consecutive, you can have consecutive write cycles
(refer to “Bursts” on page 3–13 ). Non-consecutive addresses are split
into two transfers and you must pause a transfer (refer to “Bursts with
Pauses” on page 3–14 ).
Isolated Write
Figure 3–7 shows an isolated write transaction on a burst of four (narrow
mode). The Avalon interface receives a write request, which the
controller immediately accepts. It then transfers the write data (the exact
timing may vary) to the QDRII SRAM interface. As it receives only half
the required data for a burst of four, it masks the second part of the burst
on the QDRII SRAM interface as invalid.
Figure 3–7. Isolated Write—Burst of Four (Narrow Mode)
clk
avl_write
avl_data_wr[35:0]
avl_adr_wr[19:0]
avl_wait_request_wr
write_clk
system_clk
00010002
0001
qdrii_d[17:0]
qdrii_a[19:0]
0001
0001
0002
qdrii_bwsn[1:0]
qdrii_wpsn
00
11
Altera Corporation
MegaCore Version 9.1 3–11
November 2009
QDRII SRAM Controller MegaCore Function User Guide
相关PDF资料 |
PDF描述 |
|---|---|
| IP-VITERBI/SS | IP VITERBI LOW-SPEED |
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| IPR-CSC | IP COLOR SPACE CONVERTER RENEW |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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