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参数资料
| 型号： | L64007 |
| 厂商： | LSI CORP |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP160 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 166/166页 |
| 文件大小： | 1015K |
| 代理商： | L64007 |
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register
17 Wed May 28 17:37:25 1997
Draft 1/21/97
L64007 MPEG-2, DVB, JSAT Transport Demultiplexer Technical Manual
4-17
PRE.4 for Rev. D
Copyright 1997 by LSI Logic Corporation. All rights reserved.
The addresses of the lter match and mask patterns are from 0xFFE00
to 0xFFF7F. The address location for match/mask pattern set M, byte N,
is:
pattern[set M, byte N] address =
0b1111.1111.111n.nnnm.mmmm
where M = 0bmmmmm is {0-31}, and N = 0bnnnn is {0-11}
Each address location contains one byte of match pattern and one byte
of mask pattern.
MATCH REGISTER
Match Register set m, byte n
[15:8]
This is byte n of the 12-byte matching pattern.
MASK REGISTER
Mask Register set m, byte n
[7:0]
This is byte n of the 12-byte matching pattern. Each bit
of the masking pattern controls the ltering of each bit of
the section data. When a masking bit is set to 0, ltering
is active for that corresponding bit. When the masking bit
is set to 1, the corresponding bit pattern is a “don’t care”
bit.
information on the use of the match and mask patterns.
4.6
Adaptation
Field Control
Registers
(Group 3)
This group of registers controls the processing of transport adaptation
elds stored in a special cyclic buffer through the MMU. Any adaptation
eld from all other PIDs can be stored in this cyclic buffer, provided their
AF bit is set to 1.
For a description of the AMRF in Group 3, see Section 4.10, “Address
15
8 7
0
Match Register
Mask Register
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参数描述 |
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