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参数资料
| 型号： | M-ORT82G52BM680-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1296 CLBS, 333000 GATES, PBGA680 |
| 封装： | PLASTIC, FBGA-680 |
| 文件页数： | 18/94页 |
| 文件大小： | 2104K |
| 代理商： | M-ORT82G52BM680-DB |
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Lattice Semiconductor
ORCA ORT82G5 Data Sheet
25
Figure 10. XAUI Link Synchronization State Diagram
Multichannel Alignment
The alignment FIFO allows the transfer of all data to the system clock. The Multi-Channel Alignment block (Figure
6) allows the system to be congured to allow the frame alignment of multiple slightly varying data streams. This
optional alignment ensures that matching SERDES streams will arrive at the FPGA end in perfect data synchroni-
zation.
Loss_of_Sync
sync_status ≤ FAIL
enable_CDET ≤ TRUE
sync_complete
reset
Comma_Detect_1
enable_CDET ≤ FALSE
cg_bad
cg_comma
cg_bad
Comma_Detect_2
Comma_Detect_3
cg_comma
Sync_Aqc’d_1
Sync_Aqc’d_1a
sync_status ≤ OK
no_comma
sync_status ≤ OK_NOC
cg_bad
cg_comma
Sync_Aqc’d_2
Sync_Aqc’d_3
Sync_Aqc’d_4
Sync_Aqc’d_2a
Sync_Aqc’d_3a
Sync_Aqc’d_4a
gd_cg ≤ gd_cg + 1
gd_cg ≤ 0
cg_good
cg_good x
(gd_cg ! = 3)
cg_bad
cg_good x (gd_cg = 3)
cg_good x
(gd_cg ! = 3)
cg_bad
cg_good*(gd_cg=3)
cg_good
cg_bad
cg_good x (gd_cg = 3)
cg_good
cg_good x
(gd_cg ! = 3)
cg_bad
gd_cg ≤ 0
gd_cg ≤ gd_cg + 1
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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