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参数资料
| 型号： | MT42L64M32D1KL-3 IT:A |
| 厂商： | Micron Technology Inc |
| 文件页数： | 125/164页 |
| 文件大小： | 0K |
| 描述： | IC DDR2 SDRAM 2GBIT 168FBGA |
| 标准包装： | 1,000 |
| 格式 - 存储器： | RAM |
| 存储器类型： | 移动 LPDDR2 SDRAM |
| 存储容量： | 2G（64M x 32） |
| 速度： | 333MHz |
| 接口： | 并联 |
| 电源电压： | 1.14 V ~ 1.3 V |
| 工作温度： | -25°C ~ 85°C |
| 封装/外壳： | 168-WFBGA |
| 供应商设备封装： | 168-FBGA（12x12） |
| 包装： | 散装 |
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2Gb: x16, x32 Mobile LPDDR2 SDRAM S4
AC and DC Logic Input Measurement Levels for Differential
Signals
Figure 86: Single-Ended Requirements for Differential Signals
V DDCA or V DDQ
V SEH(AC)
V SEH(AC)min
V DDCA /2 or V DDQ /2
CK or DQS
V SEL(AC)max
V SEL(AC)
V SSCA or V SSQ
Time
Note that while CA and DQ signal requirements are referenced to V REF , the single-ended
components of differential signals also have a requirement with respect to
V DDQ /2 for DQS, and V DDCA /2 for CK.
The transition of single-ended signals through the AC levels is used to measure setup
time. For single-ended components of differential signals, the requirement to reach
V SEL(AC)max or V SEH(AC)min has no bearing on timing. This requirement does, however,
add a restriction on the common mode characteristics of these signals (see Table 63
(page 119) for CK/CK# single-ended requirements, and Table 65 (page 119) for DQ and
DQM single-ended requirements).
Table 68: Single-Ended Levels for CK, CK#, DQS, DQS#
LPDDR2-1066 to LPDDR2-466
LPDDR2-400 to LPDDR2-200
Symbol
Parameter
Min
Max
Min
Max
Unit Notes
V SEH(AC)
Single-ended HIGH
(V DDQ /2) + 0.220
Note 1
(V DDQ /2) + 0.300
Note 1
V
2, 3
level for strobes
Single-ended HIGH
(V DDCA /2) + 0.220
Note 1
(V DDCA /2) + 0.300
Note 1
V
2, 3
level for CK, CK#
V SEL(AC)
Single-ended LOW
Note 1
(V DDQ /2) - 0.220
Note 1
(V DDQ /2) + 0.300
V
2, 3
level for strobes
Single-ended LOW
Note 1
(V DDCA /2) - 0.220
Note 1
(V DDCA /2) + 0.300
V
2, 3
level for CK, CK#
Notes:
1. These values are not defined, however, the single-ended signals CK, CK#, DQS0, DQS#0,
DQS1, DQS#1, DQS2, DQS#2, DQS3, DQS#3 must be within the respective limits
(V IH(DC)max / V IL(DC)min ) for single-ended signals, and must comply with the specified limi-
tations for overshoot and undershoot (see Figure 91 (page 130)).
PDF: 09005aef83f3f2eb
2gb_mobile_lpddr2_s4_g69a.pdf – Rev. N 3/12 EN
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PDF描述 |
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| GSC60DTEI | CONN EDGECARD 120POS .100 EYELET |
| MT42L64M32D1KL-25 IT:A | IC DDR2 SDRAM 2GBIT 168FBGA |
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