参数资料
| 型号： | CORE1553BRT-AR |
| 厂商： | Microsemi SoC |
| 文件页数： | 46/74页 |
| 文件大小： | 0K |
| 描述： | IP MODULE CORE1553 REMOTE TERM |
| 标准包装： | 1 |
| 系列： | * |
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Testbench Operation and Modification
The VHDL code below shows a simple code fragment that generates a 10-word BC–to–RT 1 subaddress
5 message, with data incrementing from 1200 hex, which then displays the message. “print_msgout” is a
procedure provided in the underlying Core1553B package that displays the message details. It needs to
pass the two record structures described above.
signal
signal
signal
signal
BUSASTART
BUSAMSG
BUSABUSY
BUSAOUT
:
:
:
:
BOOLEAN;
TQMSGREQ;
BOOLEAN;
TQMSGOUT;
begin
process
begin
BUSAMSG.RT
BUSAMSG.TX
BUSAMSG.SA
BUSAMSG.MCWC
BUSAMSG.RTRT
BUSAMSG.DATA
<=
<=
<=
<=
<=
<=
1;
0;
5;
10;
FALSE;
initdata(16#1200#);
-- Do the message
BUSASTART <= TRUE;
wait for 0 ns;
BUSASTART <= FALSE;
wait for 0 ns;
while BUSABUSY loop
wait for 1 us;
end loop;
-- Display the data transmitted
print_msgout(BUSAMSG,BUSAOUT);
wait;
end process;
Revision 3
46
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