参数资料
| 型号： | IP-RLDRAMII |
| 厂商： | Altera |
| 文件页数： | 18/62页 |
| 文件大小： | 0K |
| 描述： | IP RLDRAM II CONTROLLER |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | RLDRAM II 控制器 |
| 许可证： | 初始许可证 |
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Block Description
Figure 2–5. DQS Group Block Diagram—DQS Mode, SIO Devices
control_doing_wr
D
Q
dq_oe
D
Q
control_wdata
2W
W
D
W
EN
Q
D
Q
0
D
control_wdata_valid
D
Q
D
Q
1
EN
control_rdata
2W
W
write_clk
Q
D
Q
W
Q
D
Q
D
dq_capture_clk
DQS
capture_clk
Note 4
DQS Delay
(1)
(2)
(3)
(4)
This figure shows the logic for one Q output and one D input only.
All clocks are clk , unless marked otherwise.
Bus width W is dependent on the Q per DQS parameter.
Invert combout of the I/O element (IOE) for the dqs pin before feeding in to inclock of the IOE for the Q pin.
This inversion is automatic if you use an altdq megafunction for the Q pins.
Datapath Example
controller and memory configuration has the following parameters:
■
■
■
DQS mode
Two 18-bit CIO RLDRAM II devices. Each RLDRAM II device has
two rldramii_qk[] data strobes, each associated with 9-bits of
data
36-bit RLDRAM II interface, which requires a 72-bit datapath
interface
2–8 MegaCore Version 9.1
RLDRAM II Controller MegaCore Function User Guide
Altera Corporation
November 2009
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| IPR-PCI/MT32 | 功能描述:开发软件 PCI 32b MasterTarget MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-PCI/MT64 | 功能描述:开发软件 PCI 64b MasterTarget MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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