参数资料
| 型号： | IP-RLDRAMII |
| 厂商： | Altera |
| 文件页数： | 29/62页 |
| 文件大小： | 0K |
| 描述： | IP RLDRAM II CONTROLLER |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | RLDRAM II 控制器 |
| 许可证： | 初始许可证 |
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Functional Description
Figure 2–13. Write Following a Read
clk
Local_Interface
local_write_req
local_read_req
local_addr[]
local_ba[]
local_wdata_req
local_wdata[]
local_dm[]
RLDRAM_II_Interface
rldramii_clk
rldramii_clk_n
rldramii_cs_n
rldramii_we_n
rldramii_ref_n
A
A
B
B
00
01
rldramii_a[]
rldramii_ba[]
A
A
B
B
rldramii_dm[]
rldramii_dq[ ]
11
0 1
00
0 1
11
rldramii_qk[]
rldramii_qvld[]
Reads
When you assert local_read_req , the control logic issues the read
transaction immediately at the memory interface.
In DQS mode the read data, rldramii_dq[] (CIO devices) or
rldramii_q[] (SIO devices), and the QVLD signals,
rldramii_qvld[] , are captured using the delayed rldramii_qk[]
data strobes that have been phase shifted using the dedicated DQS delay
circuitry.
In non-DQS mode the read data, rldramii_dq[] or rldramii_q[] ,
and the QVLD signals, rldramii_qvld[] , are captured using an
external capture clock.
Altera Corporation
November 2009
MegaCore Version 9.1 2–19
RLDRAM II Controller MegaCore Function User Guide
相关PDF资料 |
PDF描述 |
|---|---|
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| IP-SRAM/QDRII | IP QDRII SRAM CONTROLLER |
相关代理商/技术参数 |
参数描述 |
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| IPR-PCI/MT32 | 功能描述:开发软件 PCI 32b MasterTarget MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
| IPR-PCI/MT64 | 功能描述:开发软件 PCI 64b MasterTarget MegaCore RENEWAL RoHS:否 制造商:Atollic Inc. 产品:Compilers/Debuggers 用于:ARM7, ARM9, Cortex-A, Cortex-M, Cortex-R Processors |
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