参数资料
| 型号： | IP-RLDRAMII |
| 厂商： | Altera |
| 文件页数： | 21/62页 |
| 文件大小： | 0K |
| 描述： | IP RLDRAM II CONTROLLER |
| 标准包装： | 1 |
| 系列： | * |
| 类型： | MegaCore |
| 功能： | RLDRAM II 控制器 |
| 许可证： | 初始许可证 |
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Functional Description
Figure 2–7. Memory Interface
RLDRAM II
Device 1
rldramii_dq[35:27]
M
N
O
P P
rldramii_qk[3]
rldramii_dq[26:18]
I
J
K
L
rldramii_qk[2]
RLDRAM II
Device 0
rldramii_dq[17:9]
E
F
G
H
rldramii_qk[1]
rldramii_dq[8:0]
A
B
C
D
rldramii_qk[0]
Data associated with rldramii_qk[] rising edge
Data associated with rldramii_qk[] falling edge
Figure 2–8. Datapath Interface
capture_clk[1]
capture_clk[0]
control_rdata[]
N
J
M
I
F
B
E
A
P
L
O
K
H
D
G
C
Data associated with rldramii_qk[] rising edge
Data associated with rldramii_qk[] falling edge
delayed rldramii_qk[] signal is located in the lower half-bit locations
of control_rdata[] . Any read data captured on the falling edge of the
delayed rldramii_qk[] signal is located in the upper half-bit locations
Altera Corporation
November 2009
MegaCore Version 9.1 2–11
RLDRAM II Controller MegaCore Function User Guide
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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