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参数资料
| 型号： | LXT6251A |
| 英文描述： | ATM/SONET MAPPER|CMOS|QFP|208PIN|PLASTIC |
| 中文描述： | 的ATM / SONET的映射器|的CMOS | QFP封装| 208PIN |塑料 |
| 文件页数： | 44/76页 |
| 文件大小： | 995K |
| 代理商： | LXT6251A |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页当前第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页
LXT6251A
—
21 E1 SDH Mapper
44
Datasheet
Figure 15. Receive Telecom Bus Timing
Table 12. Receive Telecom Bus Timing Parameters
Parameter
Symbol
Min
Typ
Max
Unit
DTBCLK Input clock cycle time
tDTBcyc
6.48/19.44
MHz
MTBCLK Input clock cycle time
tMTBcyc
6.48/19.64
MHz
Any telecom bus input setup time to DTBCLK falling edge
tDTBsu
3
-
-
ns
Any telecom bus input hold time after DTBCLK falling
edge
tDTBh
5
-
-
ns
Any telecom bus input setup time to MTBCLK falling edge
tDTBsu_adm
4
-
-
ns
Any telecom bus input hold time after MTBCLK falling
edge
tDTBh_adm
3
-
-
ns
t
DTBh
t
DTBsu
t
DTBcyc
t
DTBh_adm
t
DTBsu_adm
t
MTBcyc
DTBCLK
DTBDATA<7:0>
DTBJ0J1EN
DTBPAYEN
DTBH4EN
DTBTUGEN
TERMINAL and ADD/DROP MODE
ADD/DROP MODE ONLY
MTBCLK
DTBDATA<7:0>
DTBJ0J1EN
DTBPAYEN
DTBH4EN
DTBTUGEN
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