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参数资料
| 型号： | SYM53C895V5 |
| 厂商： | LSI CORP |
| 元件分类： | 总线控制器 |
| 英文描述： | SCSI BUS CONTROLLER, PBGA272 |
| 封装： | 27 X 27 MM, 1.27 MM PITCH, PLASTIC, BGA-272 |
| 文件页数： | 241/326页 |
| 文件大小： | 2938K |
| 代理商： | SYM53C895V5 |
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Index
IX-7
S
SACK/ Status bit 5-37
SATN/ Active bit 5-70
SATN/ Status bit 5-37
SBDL register 5-89
SBR register 5-64
SBSY Status bit 5-37
SC_D/ Status bit 5-37
SCID register 5-28
SCLK bit 5-82
SCLK Quadrupler Enable 5-82
SCLK Quadrupler Select 5-82
SCNTL0 register 5-17
SCNTL1 register 5-20
SCNTL2 register 5-23
SCNTL3 register 5-25
Scratch register 5-64
SCRATCHA register 5-60
SCRATCHA/B Operation bit 5-51
SCRATCHB register 5-90
SCRIPTS bit 5-75
SCRIPTS processor 2-7
instruction prefetching 2-8
internal RAM for instruction storage 2-8
performance 2-7
SCRIPTS RAM 2-8
SCRATCHA/B Operation bit 5-51
SCSI
core 2-2
LVD Link 2-16
termination 2-24
TolerANT Technology 1-4
Ultra2 2-10
SCSI ATN Condition bit 5-66
SCSI Bus Data Lines register 5-89
SCSI C_D/ Signal bit 5-43
SCSI Chip ID register 5-28
SCSI CLK frequency quadrupling 5-83
SCSI clock quadrupler 5-82
Frequency Lock bit 5-89
SCSI clock rates 5-26
SCSI Control Enable bit 5-83
SCSI Control One register 5-20
SCSI Control Three register 5-25
SCSI Control Two register 5-23
SCSI core 2-2
SCSI Data High impedance bit 5-55
SCSI Destination ID register 5-33
SCSI Differential Mode bit 5-84
SCSI Disconnect Unexpected bit 5-23
SCSI encoded destination ID 6-20
SCSI FIFO Test Read bit 5-86
SCSI FIFO Test Write bit 5-87
SCSI First Byte Received register 5-35
SCSI High-Impedance Mode bit 5-84
SCSI I/O instructions 6-13
SCSI I_O/ Signal bit 5-43
SCSI Input Data Latch register 5-88
SCSI instructions
block move 6-6
read/write 6-22
SCSI Interrupt Enable One register 5-68
SCSI Interrupt Enable Zero register 5-66
SCSI Interrupt Pending bit 5-48
SCSI Interrupt Status One register 5-72
SCSI Interrupt Status Zero register 5-69
SCSI Isolation Mode bits 5-82
SCSI Longitudinal Parity register 5-73
SCSI Loopback Mode bit 5-84
SCSI Low Level Mode bit 5-85
SCSI Mode bit 5-88
SCSI MSG/ Signal bit 5-43
SCSI Output Control Latch register 5-36
SCSI Output Data Latch register 5-89
SCSI Parity Error bit 5-68
SCSI Phase Mismatch bit 5-66
SCSI Reset Condition bit 5-67
SCSI RST/ Received bit 5-71
SCSI RST/ Signal bit 5-41
SCSI SCRIPTS operation 6-2
sample instruction 6-3
SCSI SDP0/ Parity Signal bit 5-41
SCSI SDP1 Signal bit 5-45
SCSI Selected As ID bits 5-80
SCSI Selector ID register 5-36
SCSI Status One register 5-42
SCSI Status Two register 5-44
SCSI Status Zero register 5-40
SCSI Synchronous Offset Maximun 5-81
SCSI Synchronous Offset Zero bit 5-81
SCSI Synchronous Transfer Period bits 5-29
SCSI Test One register 5-82
SCSI Test Three register 5-85
SCSI Test Two register 5-83
SCSI Test Zero register 5-80
SCSI Timer One register 5-77
SCSI Timer Zero register 5-76
SCSI Transfer register 5-29
SCSI True End of Process bit 5-51
SCSI Valid bit 5-36
SCSI Wide Residue register 5-74
SCSI-1 Transfers
(Differential, 4.17 Mbytes/s) timing 7-54
(Single-Ended, 5.0 Mbytes/s) timing 7-54
SCSI-2 Fast Transfers 10.0 Mbytes/s (8-Bit Transfers) or
20.0 Mbytes/s (16-Bit Transfers)
40 MHz Clock timing 7-55
50 MHz Clock timing 7-56
SDID register 5-33
select instruction 6-16
select with ATN/ bit 6-20
Select with SATN/ on a Start Sequence 5-18
Selection Response Logic Test bits 5-81
Selection Timeout 5-77
Semaphore bit 5-47
SERR/ enable (SE) 5-4
set/clear carry bit 6-20
set/clear SACK/ bit 6-20
Set/Clear SATN/ bit 6-20
Set/Clear target mode bit 6-20
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