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参数资料
| 型号： | SYM53C895V5 |
| 厂商： | LSI CORP |
| 元件分类： | 总线控制器 |
| 英文描述： | SCSI BUS CONTROLLER, PBGA272 |
| 封装： | 27 X 27 MM, 1.27 MM PITCH, PLASTIC, BGA-272 |
| 文件页数： | 257/326页 |
| 文件大小： | 2938K |
| 代理商： | SYM53C895V5 |
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2-10
Functional Description
indirect type, the additional dword is accessed in a subsequent bus
ownership. If the instruction is a table indirect block move, the
SYM53C895 uses two accesses to obtain the four dwords required, in
two bursts of two dwords each.
Note:
This feature only works if prefetching is disabled.
2.5 Designing an Ultra2 SCSI System
Since Ultra2 SCSI is based on existing SCSI standards, it can use
existing driver programs as long as the software is able to negotiate for
Ultra2 SCSI synchronous transfer rates. Additional software
modications may be needed to take advantage of the new features in
the SYM53C895.
In the area of hardware, LVD SCSI is required to achieve Ultra2 SCSI
transfer rates and to support the longer cable and additional devices on
the bus. All devices on the bus must have LVD SCSI to guarantee Ultra2
SCSI transfer rates. For additional information on Ultra2 SCSI, refer to
the SPI-2 working document which is available from the SCSI BBS
referenced at the beginning of this manual. Chapter 7, Electrical
Characteristics contains Ultra2 SCSI timing information. In addition to the
guidelines in the draft standard, make the following software and
hardware adjustments to accommodate Ultra2 SCSI transfers:
Step 1.
Set the Ultra Enable bit, bit 7 in the SCNTL3 register, to enable
Ultra2 SCSI transfers.
Step 2.
Set the TolerANT Enable bit, bit 7 in the STEST3 register,
whenever the Ultra Enable bit is set.
Step 3.
Do not extend the SREQ/SACK ltering period with STEST2
bit 1. When the Ultra Enable bit is set, the ltering period is
xed at 8 ns for Ultra2 SCSI or 15 ns for Ultra SCSI, regardless
of the value of the SREQ/SACK Filtering bit.
Step 4.
Use the SCSI clock quadrupler.
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