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参数资料
| 型号： | SCD223110QCD |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 256K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | METRIC, QFP-100 |
| 文件页数： | 16/178页 |
| 文件大小： | 2247K |
| 代理商： | SCD223110QCD |
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CD2231 — Intelligent Two-Channel LAN and WAN Communications Controller
112
Datasheet
8.3.2.2
Transmit Clock Option Register (TCOR)
This register controls the transmit bit rate generator and Local Loopback mode.
Bits 7:5
These bits select the clock source for the transmit bit rate generator.
NOTE: See the description of clock options in Section 5.5.
Bit 4
Reserved – must be ‘0’.
Bit 3
Times 1 external clock. This bit is set to ‘1’ when the user supplies the data clock on
TXCIN pin whose frequency is equal to the transmit data rate. When using the exter-
nal 1
× clock or the clock from the receiver’s DPLL, the TBPR must be programmed
to 01h.
Bit 2
Reserved – must be ‘0’.
Bit 1
Local Loopback mode
1 = enables the Local Loopback mode
0 = disables the Local Loopback mode
Bit 0
Reserved – must be ‘0’.
8.4
Channel Command and Status Registers
8.4.1
Channel Command Register (CCR)
There are two CCR command sets. Mode 1 (if bit 7 is ‘0’) commands affect basic channel control.
In Mode 2 (if bit 7 is ‘1’), additional commands that control timer functions are available.
Register Name: TCOR
Register Description: Transmit Clock Option
Default Value: x’00
Access: Byte Read/Write
Intel Hex Address: x’C2
Motorola Hex Address: x’C0
Bit 7Bit 6Bit 5Bit 4Bit 3
Bit 2Bit 1
Bit 0
ClkSel2
ClkSel1
ClkSel0
0
Ext-1X
0
LLM
0
ClkSel2
ClkSel1
ClkSel0
Select
0
Clk 0
0
1
Clk 1
0
1
0
Clk 2
0
1
Clk 3
1
0
Clk 4
1
0
1
Reserved
1
0
External clock
1
Receive clock
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