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参数资料
| 型号： | SCD223110QCD |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 256K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | METRIC, QFP-100 |
| 文件页数： | 55/178页 |
| 文件大小： | 2247K |
| 代理商： | SCD223110QCD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页当前第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页
CD2231 — Intelligent Two-Channel LAN and WAN Communications Controller
148
Datasheet
B Transmit Buffer Status (BTBSTS) — Async-HDLC/PPP Mode
Bit 7
Berr – Bus error (set by the CD2231, and cleared by the host)
0 = No bus error
1 = Bus error was detected on the last transfer
Bit 6
EOF – End of frame (set and cleared by the host)
0 = This buffer is not the last in frame/block.
1 = This buffer is the last in frame/block.
Bit 5
EOB – The end of a transmit buffer (set by the CD2231, and cleared by the host).
The end of a host supplied transmit buffer has been reached.
Bits 4:3
Reserved – must be ‘0’.
Bit 2
map32 – Map all transmit characters from 00–1F (set and cleared by the host)
0 = Use the normal TXACCM map.
1 = Map all characters in the range from 00–1F.
Bit 1
INTR – Interrupt
0 = No interrupt required after the buffer is transmitted.
1 = Interrupt required after the buffer is transmitted.
Bit 0
2231own – Ownership of the transmit buffer (set by the host and cleared by the
CD2231)
0 = Buffer is owned by the host, and not ready for use by the CD2231.
1 = Buffer is owned by the CD2231, and is ready for use by the CD2231.
To start transmission of a buffer, the host must set the ATBADR/BTBADR (Transmit Buffer
Address) and ATBCNT/BTBCNT (Transmit Buffer Count) registers, and then set the 2231own bit.
If the CD2231 is to generate and send the CRC for the frame, the CRC bit in COR1 must be set. If
the buffer contains the end of a frame, the EOF bit must also be set. When the buffer has been sent,
the EOB bit is set by the CD2231, and 2231own is reset, allowing a new buffer to be allocated.
8.6.5.8
A Transmit Buffer Status (ATBSTS) — SLIP/MNP4 Mode
Register Name: BTBSTS
Register Description: Transmit Buffer ‘B’ Status
Default Value: x’00
Access: Byte Read/Write
Intel Hex Address: x’5D
Motorola Hex Address: x’5E
Bit 7Bit 6Bit 5Bit 4Bit 3
Bit 2Bit 1
Bit 0
Berr
EOF
EOB
0
map32
INTR
2231own
Register Name: ATBSTS
Register Description: Transmit Buffer ‘A’ Status
Default Value: x’00
Access: Byte Read/Write
Intel Hex Address: x’5C
Motorola Hex Address: x’5F
Bit 7Bit 6Bit 5
Bit 4
Bit 3Bit 2Bit 1Bit 0
Berr
EOF
EOB
0
INTR
2231own
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