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参数资料
| 型号： | SCD223110QCD |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 256K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | METRIC, QFP-100 |
| 文件页数： | 65/178页 |
| 文件大小： | 2247K |
| 代理商： | SCD223110QCD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页当前第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页
Intelligent Two-Channel LAN and WAN Communications Controller — CD2231
Datasheet
157
9.3
AC Electrical Characteristics
Symbol
Parameter
MIN
MAX
(Sheet 1 of 2)
tPERIOD
Period of CLK input (35 MHz maximum)
28.57
t1
CLK high to BUSCLK high
20
t
2
CLK high to BUSCLK low
20
Bus Arbitration
t11
CLK high to BGACK* tristate
25
t12
BGIN* low to address valid1
40
t13
Address hold after CLK high
0
t14
CLK high to address tristate
25
t15
CLK high to ADLD* low
25
t16
CLK high to ADLD* high
20
t17
Address setup to ADLD* high
15
t18
CLK high to AEN*/DATEN*/DATDIR* high
25
t19
CLK high to AEN*/DATEN*/DATDIR* tristate
25
t20
CLK high to AEN*/DATEN*/DATDIR* low
25
DMA Read
t
21
Data setup to CLK high
10
t
22
Data hold after CLK high
15
t
23
CLK high to address valid
30
t
24
CLK low to AS* low
25
t
25
CLK high to AS* high
20
t
26
CLK low to DS* low
25
t
27
CLK high to DS* high
20
t
28
DTACK* low setup to CLK high
10
t
29
DTACK* high setup to CLK high (to avoid false termination)
50
DMA Write
t
31
CLK high to data valid
40
t
32
Data hold after CLK high
0
t
33
CLK low to DS* low
25
t
34
CLK high to DS* high
20
t
35
DTACK* low setup to CLK high
10
t
36
DTACK* high setup to CLK high (to avoid false termination)
50
Host Read/Write
t
41
DS* and CS* low setup to CLK high
7
相关PDF资料 |
PDF描述 |
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参数描述 |
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