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参数资料
| 型号： | SCD223110QCD |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 256K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | METRIC, QFP-100 |
| 文件页数： | 34/178页 |
| 文件大小： | 2247K |
| 代理商： | SCD223110QCD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页当前第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页
Intelligent Two-Channel LAN and WAN Communications Controller — CD2231
Datasheet
129
Bit 6
EOF – End of frame
The EOF bit indicates that a valid end of frame (7E) character has been received, and
the 7E was not preceded by a 7D.
Bit 5
RxAbt – Receive abort
The rxabt bit indicates that an abort sequence (7D–7E) has been received.
Bit 4
CRC – Receive CRC error
(The terms CRC and FCS are used interchangeably in this document.)
The CRC bit indicates that a frame with a valid end of frame has been received, but
the FCS was not correct. CRC is set only if EOF is set.
Bit 3
OE – Overrun error
The OE bit indicates that the receiver buffer and FIFO have been overrun. At least
one new character has been received, but lost since there was no room available in
the receiver buffer and/or FIFO.
Bit 2
FE – Framing error
The FE bit indicates that a character has been received with an incorrect Stop bit. The
stop bit was ‘0’; it should have been ‘1’.
Bit 1
Reserved – always returns ‘0’ when read.
Bit 0
Break – Break detection
The Break bit indicates that a break has been received. A break is a continuous
sequence of at least ten ‘0’ bits.
Note:
0E, FE, and break are cumulative over the entire packet in PPP mode. This means that the
respective error occurred somewhere in the packet, but did not cause an immediate interrupt.
The following table defines the encoding of RxAbt and FE for an aborted receive frame:
SLIP Mode
If RxData in IER is set, these interrupts are enabled.
Bit 7
Reserved – always returns ‘0’ when read.
Bit 6
EOF – End of frame
The EOF bit indicates that a valid end of frame (7E) character has been received, and
the 7E was not preceded by a 7D.
RxAbt
FE
Error
0
None
0
1
Not used
1
0
Received abort sequence: x’7D, x’7E
1
Framing error caused a frame abort
Register Name: RISRl
Register Description: Receive Interrupt Status — Low
Default Value: x’00
Access: Byte Read only
Intel Hex Address: x’8A
Motorola Hex Address: x’89
Bit 7
Bit 6Bit 5Bit 4Bit 3Bit 2Bit 1Bit 0
0
EOF
RxAbt
0
OE
FE
0
Break
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PDF描述 |
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