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参数资料
| 型号： | SCD223110QCD |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 256K bps, SERIAL COMM CONTROLLER, PQFP100 |
| 封装： | METRIC, QFP-100 |
| 文件页数： | 33/178页 |
| 文件大小： | 2247K |
| 代理商： | SCD223110QCD |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页
CD2231 — Intelligent Two-Channel LAN and WAN Communications Controller
128
Datasheet
RISRl — Asynchronous Mode
If RxData in IER is set, these interrupts are enabled.
Bit 7
Timeout – indicates that the receive FIFO is empty, and no data has been received
within the receive timeout period. There is no data character associated with this sta-
tus, and no other status bits are valid if the Time-Out bit is set.
Bits 6:4
Special character detect
Bit 3
Overrun error – indicates that new data has arrived, but the CD2231 FIFO or holding
registers are full. The new data is lost and the overrun indication is flagged on the
last character received before the overrun occurred.
Bit 2
Parity error – indicates that a parity error has occurred.
Bit 1
Framing error – indicates that a bad Stop bit is detected.
Bit 0
Break – indicates that a break is detected.
RISRl — Async-HDLC / PPP / MNP4 Mode
If RxData in IER is set, these interrupts are enabled.
Bit 7
Reserved – always returns ‘0’ when read.
Register Name: RISRl
Register Description: Receive Interrupt Status — Low
Default Value: x’00
Access: Byte Read only
Intel Hex Address: x’8A
Motorola Hex Address: x’89
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Timeout
SCdet2
SCdet1
SCdet0
OE
PE
FE
Break
SCdet[2:0]
Status
000
None detected
001
Special Character 1 matched
010
Special Character 2 matched
011
Special Character 3 matched (only if ESCDE is enabled in COR3)
100
Special Character 4 matched (only if ESCDE is enabled in COR3)
111
Character is within the inclusive range of the characters in the Special
Character Range low and high registers (only if RngDE is enabled in
COR3). Special character match can be enabled for error characters by
COR7.
Register Name: RISRl
Register Description: Receive Interrupt Status — Low
Default Value: x’00
Access: Byte Read only
Intel Hex Address: x’8A
Motorola Hex Address: x’89
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
0
EOF
RxAbt
CRC
OE
FE
0
Break
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PDF描述 |
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参数描述 |
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