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参数资料
| 型号： | ARM940T |
| 厂商： | Electronic Theatre Controls, Inc. |
| 英文描述： | TECHNICAL REFERENCE MANUAL |
| 中文描述： | 技术参考手册 |
| 文件页数： | 24/230页 |
| 文件大小： | 1144K |
| 代理商： | ARM940T |
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Programmer
’
s Model
2-6
Copyright 1999, 2000 ARM Limited. All rights reserved.
ARM DDI 0144B
2.3.1
Accessing CP15 registers
The terms and abbreviations shown in Table 2-3 on page 2-6 are used throughout this
section.
In all cases, reading from, or writing any data values to any CP15 registers, including
those fields specified as
unpredictable
or
should be zero
, does not cause any permanent
damage.
All CP15 register bits that are defined and contain state, are set to zero by
BnRES
except the V bit in register 1, which takes the value of macrocell input
VINITHI
when
BnRES
is asserted.
You can only access CP15 registers with
MRC
and
MCR
instructions in a privileged mode.
The instruction bit pattern of the
MCR
and
MRC
instructions is shown in Figure 2-1 on
page 2-6. The assembler for these instructions is:
MCR/MRC{cond} P15,opcode_1,Rd,CRn,CRm,opcode_2
Figure 2-1 CP15 MRC and MCR bit pattern
Table 2-3 CP15 abbreviations
Term
Abbreviation
Description
Unpredictable
UNP
For reads, the data returned when reading from this
location is unpredictable. It can have any value.
For writes, writing to this location causes unpredictable
behavior, or an unpredictable change in device
configuration.
Should be zero
SBZ
When writing to this location, all bits of this field should
be 0.
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16 15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0
1 1 1 0
1 1 1 1
1
CRm
opcode_2
Rd
CRn
L
opcode_1
Cond
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PDF描述 |
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