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参数资料
| 型号： | RPIXP2850BB |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1400 MHz, RISC PROCESSOR, PBGA1356 |
| 封装： | 37.50 X 37.50 MM, 1 MM PITCH, FCBGA-1356 |
| 文件页数： | 19/130页 |
| 文件大小： | 1782K |
| 代理商： | RPIXP2850BB |
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Intel IXP2800 and IXP2850 Network Processors
Electrical Specifications
Datasheet
115
4.4.9
Flow Control Bus
This section lists the LVDS parameters for the Flow Control Bus. Table 55 lists the Driver DC
specifications. The Flow Control Bus AC timing parameters are the same as those specified for the
SPI-4 LVDS data path; implementers should refer to Table 50, Table 51, and Table 52 for AC
timing details.
Table 54. SPI4-2 Transmit FIFO Status Bus Timing Parameters
Parameter
Symbol
Min
Max
Units
TSTAT[1:0] Setup to TSCLK
Rising Edge (Default Operation) 1
1. Guaranteed by design.
Tsu1
2.0
—
ns
TSTAT[1:0] Hold from TSCLK
Rising Edge (Default Operation) 1
Th1
0.5
—
ns
TSTAT[1:0] Setup to TSCLK
Falling Edge (when active edge
flipped to falling) 1
Tsu2
2.0
—
ns
TSTAT[1:0] Hold from TSCLK
Falling Edge (when active edge
flipped to falling)1
Th2
0.5
—
ns
Table 55. Flow Control Bus LVDS Driver DC Specifications
Symbol
Parameter
Min
Max
Voh
Output Voltage High
—
1375 mV
Vol
Output Voltage Low
1025 mV
—
Vod 1
1. Guaranteed by design.
Output Differential Voltage
150 mV
250 mV
Vos 1
Output Offset Voltage
1150 mV
1250 mV
Ro 1
Output Impedance, Single-Ended
40 ohms
140 ohms
Table 56. Flow Control Bus LVDS Receiver DC Specifications
Symbol
Parameter
Min
Max
Vi
Input Voltage Range
825 mV
1575 mV
Vidth
Input Differential Threshold
– 100 mV
+ 100 mV
Vhyst 1
1. Guaranteed by design.
Input Differential Hysteresis
25 mV
—
Ri 1
Receiver Differential Input Impedance
80 ohms
120 ohms
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