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参数资料
| 型号： | RPIXP2850BB |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1400 MHz, RISC PROCESSOR, PBGA1356 |
| 封装： | 37.50 X 37.50 MM, 1 MM PITCH, FCBGA-1356 |
| 文件页数： | 62/130页 |
| 文件大小： | 1782K |
| 代理商： | RPIXP2850BB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页
Intel IXP2800 and IXP2850 Network Processors
Signal Description
Datasheet
37
3.2.5
Slowport Signals
The Slowport is used to interface to asynchronous devices. Typically this will be a Flash ROM
(Boot ROM) and maintenance port of MAC devices. Slowport signals use LVTTL signaling levels
(see Table 10).
PCI_ZQ1,
PCI_ZQ2
I/O
Impedance Match. The PCI_ZQ1 pin should be tied to VSS
through a 31.6-ohm resistor. Internal circuits match the
impedance of the output drivers to the value of this resistor
when the outputs are driving a high logic level.
Note: The nominal value for ZQ1 is 31.6 ohms, and the
resistor range is 30.1 to 34 ohms. The resistor tolerance
should be +/- 1%.
The PCI_ZQ2 pin should be connected to VCC3.3 through
a 28-ohm resistor. Internal circuits match the impedance of
the output drivers to the value of this resistor when the
outputs are driving a low logic level.
Note: The nominal value for ZQ2 is 28 ohms, and the
resistor range is 27.4 to 31.6 ohms. The resistor tolerance
should be +/- 1%.
2
Total
95
Table 9.
PCI Signals (Sheet 3 of 3)
Signal Name
I/O
Description
Number
Table 10. Slowport Signals
Signal Name
I/O
Description
Number
SP_CLK
O
Clock.
1
SP_WR_L
O
Write strobe.
1
SP_RD_L
O
Read strobe.
1
SP_AD(0)
SP_AD(1)
SP_AD(2)
SP_AD(3)
SP_AD(4)
SP_AD(5)
SP_AD(6)
SP_AD(7)
I/O
Multiplexed Address and Data.
8
SP_ACK_L
I
Acknowledge signal.
1
SP_CS_L(0),
SP_CS_L(1)
O
Device selects.
2
SP_ALE_L
O
Address latch enable.
1
SP_CP/SP_A0
O
Latch enable for 16 or 32-bit data bus devices. Address [0]
for 8-bit devices.
1
SP_OE_L
O
Output enable.
1
SP_DIR/SP_A1
O
Data transaction direction. Low for read, high for write.
Address [1] for 8-bit devices.
1
Total
18
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