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参数资料
| 型号： | RPIXP2850BB |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 1400 MHz, RISC PROCESSOR, PBGA1356 |
| 封装： | 37.50 X 37.50 MM, 1 MM PITCH, FCBGA-1356 |
| 文件页数： | 7/130页 |
| 文件大小： | 1782K |
| 代理商： | RPIXP2850BB |
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Intel IXP2800 and IXP2850 Network Processors
Electrical Specifications
104
Datasheet
4.4.5.5
PCI Bus Signals Timing
Table 38. 33 MHz PCI Clock Signal AC Parameters
Symbol
Parameter
Minimum
Maximum
Unit
Tcyc
PCI_CLK cycle time
30
—
ns
Thigh
PCI_CLK high time1
1. Not tested. Guaranteed by design.
11
—
ns
Tlow
PCI_CLK low time1
11
—
ns
PCI_CLK slew rate1,2
2. 0.2 Vcc33 to 0.6 Vcc33.
14
V/ns
Figure 13. PCI Bus Signals
Table 39. 33 MHz PCI Signal Timing
Symbol
Parameter
Minimum
Maximum
Unit
Tval
CLK to signal valid delay, bused signals1
1. Bused signals are AD, CBE_L, PAR, PERR_L, SERR_L, FRAME_L, IRDY_L, TRDY_L, DEVSEL_L, and STOP_L.
211
ns
Tval (point-to-point) CLK to signal valid delay, point-to-point signals
2
2. Point-to-point signals are REQ_L and GNT_L.
212
ns
Ton
Float to active delay3
3. Not tested. Guaranteed by design.
2—
Toff
Active to float delay 3
—28
ns
Tsu
Input setup time to CLK, bused signals4
4. Bused signals are AD, CBE_L, PAR, PERR_L, SERR_L, FRAME_L, IRDY_L, TRDY_L, DEVSEL_L, and STOP_L.
7—
ns
Tsu (point-to-point)
Input setup time to CLK, point-to-point signals5
5. Point-to-point signals are REQ_L and GNT_L.
10
—
ns
Th
Input signal hold time from CLK
0
—
ns
A9393-01
T
val(max)
T
su
T
h
T
val(min)
T
on
T
off
V
test
PCI_CLK
Outputs
Inputs
Note: Vtest = 0.4 VCC33 for 3.3 volt PCI signals
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PDF描述 |
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