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参数资料
| 型号： | AD9547BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 74/104页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN/SYNCHRONIZR 64LFCSP |
| 产品变化通告： | AD9547 Mask Change 20/Oct/2010 |
| 标准包装： | 750 |
| 类型： | 时钟/频率发生器，同步器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 750kHz |
| 电源电压： | 1.71 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 带卷 (TR) |
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Data Sheet
AD9547
Rev. E | Page 71 of 104
Register0x0209 to Register0x0210—IRQ Mask
The IRQ mask register bits forma one-to-one correspondence with the bits of the IRQ monitor register (Address 0x0D02 to Address 0x0D09).
When set to Logic 1, the IRQ mask bits enable the corresponding IRQ monitor bits to indicate an IRQ event. The default for all IRQ mask
bits is Logic 0, which prevents the IRQ monitor from detecting any internal interrupts.
Table 51. IRQ Mask for SYSCLK
Address
Bit
Bit Name
Description
0x0209
[7:6]
Unused
Unused.
5
SYSCLK unlocked
Enables IRQ for indicating a SYSCLK PLL state transition from locked to unlocked.
4
SYSCLK locked
Enables IRQ for indicating a SYSCLK PLL state transition from unlocked to locked.
[3:2]
Unused
Unused.
1
SYSCLK cal complete
Enables IRQ for indicating that SYSCLK calibrationis complete.
0
SYSCLK cal started
Enables IRQ for indicating that SYSCLK calibrationhas begun.
Table 52. IRQ Mask for Distribution Sync, Watchdog Timer, and EEPROM
Address
Bit
Bit Name
Description
0x020A
[7:4]
Unused
Unused.
3
Distributionsync
Enables IRQ for indicating a distributionsync event.
2
Watchdog timer
Enables IRQ for indicating expirationof the watchdog timer.
1
EEPROM fault
Enables IRQ for indicating a fault during an EEPROM load or save operation.
0
EEPROM complete
Enables IRQ for indicating successful completionofan EEPROM load or save operation.
Table 53. IRQ Mask for the Digital PLL
Address
Bit
Bit Name
Description
0x020B
7
Switching
Enables IRQ for indicating that the DPLL is switching to a new reference.
6
Closed
Enables IRQ for indicating that the DPLL has enteredclosed-loop operation.
5
Free run
Enables IRQ for indicating that the DPLL has enteredfree-run mode.
4
Holdover
Enables IRQ for indicating that the DPLL has enteredholdover mode.
3
Frequency unlocked
Enables IRQ for indicating that the DPLL lost frequency lock.
2
Frequency locked
Enables IRQ for indicating that the DPLL has acquired frequency lock.
1
Phase unlocked
Enables IRQ for indicating that the DPLL lost phase lock.
0
Phase locked
Enables IRQ for indicating that the DPLL has acquired phase lock.
Table 54. IRQ Mask for History Update, Frequency Limit, and Phase Slew Limit
Address
Bit
Bit Name
Description
0x020C
[7:5]
Unused
Unused.
4
History updated
Enables IRQ for indicating the occurrence of a tuning word history update.
3
Frequency unclamped
Enables IRQ for indicating a state transition of the frequency limiter from clampedto
unclamped.
2
Frequency clamped
Enables IRQ for indicating a state transition of the frequency limiter from unclampedto
clamped.
1
Phase slew unlimited
Enables IRQ for indicating a state transition of the phase slew limiter from slew limitingto
not slew limiting.
0
Phase slew limited
Enables IRQ for indicating a state transition of the phase slew limiter from not slew
limitingto slew limiting.
相关PDF资料 |
PDF描述 |
|---|---|
| AD9548BCPZ-REEL7 | IC CLOCK GEN/SYNCHRONIZR 88LFCSP |
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| AD9552BCPZ-REEL7 | IC PLL CLOCK GEN LP 32LFCSP |
相关代理商/技术参数 |
参数描述 |
|---|---|
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