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参数资料
型号： XC3S700A-4FT256I
厂商： Xilinx Inc
文件页数： 51/132页
文件大小： 0K
描述： IC FPGA SPARTAN 3 256FTBGA
标准包装： 90
系列： Spartan®-3A
LAB/CLB数： 1472
逻辑元件/单元数： 13248
RAM 位总计： 368640
输入/输出数： 161
门数： 700000
电源电压： 1.14 V ~ 1.26 V
安装类型： 表面贴装
工作温度： -40°C ~ 100°C
封装/外壳： 256-LBGA
供应商设备封装： 256-FTBGA
DC and Switching Characteristics
DS529-3 (v2.0) August 19, 2010
www.xilinx.com
25
TIOPICKD
Time from the setup of data at the
Input pin to the active transition at the
ICLK input of the Input Flip-Flop (IFF).
The Input Delay is programmed.
LVCMOS25(2)
1
XC3S700A
1.82
1.95
ns
22.62
2.83
ns
33.32
3.72
ns
43.83
4.31
ns
53.69
4.14
ns
64.60
5.19
ns
75.39
6.10
ns
85.92
6.73
ns
1
XC3S1400A
1.79
2.17
ns
22.55
2.92
ns
33.38
3.76
ns
43.75
4.32
ns
53.81
4.19
ns
64.39
5.09
ns
75.16
5.98
ns
85.69
6.57
ns
Hold Times
TIOICKP
Time from the active transition at the
ICLK input of the Input Flip-Flop (IFF)
to the point where data must be held
at the Input pin. No Input Delay is
programmed.
LVCMOS25(3)
0
XC3S50A
–0.66
–0.64
ns
XC3S200A
–0.85
–0.65
ns
XC3S400A
–0.42
ns
XC3S700A
–0.81
–0.67
ns
XC3S1400A
–0.71
ns
TIOICKPD
Time from the active transition at the
ICLK input of the Input Flip-Flop (IFF)
to the point where data must be held
at the Input pin. The Input Delay is
programmed.
LVCMOS25(3)
1
XC3S50A
–0.88
ns
2
–1.33
ns
3
–2.05
ns
4
–2.43
ns
5
–2.34
ns
6
–2.81
ns
7
–3.03
ns
8
–3.83
–3.57
ns
1
XC3S200A
–1.51
ns
2
–2.09
ns
3
–2.40
ns
4
–2.68
ns
5
–2.56
ns
6
–2.99
ns
7
–3.29
ns
8
–3.61
ns
Table 20: Setup and Hold Times for the IOB Input Path(Continued)
Symbol
Description
Conditions
IFD_
DELAY_
VALUE
Device
Speed Grade
Units
-5
-4
Min
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