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参数资料
| 型号： | SPMC16V1CPU20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 122/128页 |
| 文件大小： | 571K |
| 代理商： | SPMC16V1CPU20 |
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MC68HC16V1
MOTOROLA
MC68HC16V1TS/D
93
5 Queued Serial Module
The QSM contains two serial interfaces: the queued serial peripheral interface (QSPI) and the serial
communication interface (SCI). Figure 17 shows the QSM block diagram.
Figure 17 QSM Block Diagram
5.1 Overview
The QSPI provides peripheral expansion or interprocessor communication through a full-duplex, syn-
chronous, three-line bus: data in, data out, and a serial clock. Four programmable peripheral chip-select
pins provide addressability for up to 16 peripheral devices. A self-contained RAM queue allows up to
16 serial transfers of 8 to 16 bits each, or transmission of a 256-bit data stream without CPU interven-
tion. A special wraparound mode supports continuous sampling of a serial peripheral, with automatic
QSPI RAM updating, which makes the interface to A/D converters more efficient.
The SCI provides a standard non-return to zero (NRZ) mark/space format. It operates in either full- or
half-duplex mode. There are separate transmitter and receiver enable bits and dual data buffers. A
modulus-type baud rate generator provides rates from 110 to 655 kbaud with a 20.97 MHz system
clock. Word length of either 8 or 9 bits is software selectable. Optional parity generation and detection
provide either even or odd parity check capability. Advanced error detection circuitry catches glitches
of up to 1/16 of a bit time in duration. Wake-up functions allow the CPU to run uninterrupted until mean-
ingful data is available.
QSPI
INTERFACE
LOGIC
SCI
MISO/PQS0
MOSI/PQS1
SCK/PQS2
PCS0/SS/PQS3
PCS1/PQS4
PCS2/PQS5
PCS3/PQS6
TXD/PQS7
RXD
PORT
QS
QSM BLOCK
IMB
相关PDF资料 |
PDF描述 |
|---|---|
| S1C60N05F0A0100 | MICROCONTROLLER, PQFP60 |
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相关代理商/技术参数 |
参数描述 |
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