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参数资料
| 型号： | SPMC16V1CPU20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 75/128页 |
| 文件大小： | 571K |
| 代理商： | SPMC16V1CPU20 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页当前第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MOTOROLA
MC68HC16V1
50
MC68HC16V1TS/D
Port A and B data direction registers control the direction of the pin drivers for ports A and B, respec-
tively, when the pins are configured for I/O. Setting DDA or DDB to one configures all pins in the corre-
sponding port as outputs. Clearing DDA or DDB to zero configures all pins in the corresponding port as
inputs.
3.8.2 Port C Operations
Port C pins can be used as address lines or general purpose I/O. ADDR[17:16] are selected in a single
contiguous left-justified group, to form a contiguous address space with DATA[15:0].
The port C output data register latches the data to be driven on the port C output pins. When read,
PORTC always reflects the current state of the data latches. Power-on reset can change the state of
these latches. Other sources of reset have no effect.
When read, the port C pin data register reflects the current state of the port C pins, regardless of wheth-
er the pins are configured as inputs or outputs. Writes to PORTCP have no effect.
Port C data direction register bits control the direction of the port C pin drivers when the pins are con-
figured as I/O pins. When any bit in this register is set to one, the corresponding pin is configured as an
output. When any bit in this register is cleared to zero, the corresponding pin is configured as an input.
Reset clears all bits to zero.
DDRAB — Port A/B Data Direction Register
$YFFA15
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
DDA
DDB
RESET (SINGLE-CHIP MODE):
0
PORTC — Port C Output Data Register
$YFFA18
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESERVED
PC1
PC0
PORTD
RESET:
U
PORTCP — Port C Pin Data Register
$YFFA1A
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESERVED
PCP1
PCP0
PORTDP
RESET:
CURRENT STATE OF CORRESPONDING PINS
DDRC — Port C Data Direction Register
$YFFA1C
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
RESERVED
DDC1
DDC0
DDRD
RESET:
0
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