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参数资料
| 型号： | SPMC16V1CPU20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 92/128页 |
| 文件大小： | 571K |
| 代理商： | SPMC16V1CPU20 |
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MOTOROLA
MC68HC16V1
66
MC68HC16V1TS/D
IDLE — Add Idle Clock
This field determines whether an idle clock cycle is added at the end of an external cycle to allow time
for an external device to stop driving the bus before the next address is driven on the bus by the SLIM.
0 = No idle clock cycle added
1 = One idle clock cycle added
IACK/CS — Assert CSA on IACK
This bit, with IACK in CSCR, determines whether external IACK cycles are terminated externally or in-
ternally and whether or not CSA is also asserted during an external IACK cycle. Table 46 shows the
IACK/CS field.
3.10 Factory Test Block
The test submodule supports scan-based testing of the various MCU modules. It is integrated into the
SLIM to support production test.
3.10.1 Test Registers
Test submodule registers are intended for Motorola use. Register names and addresses are provided
to indicate that these addresses are occupied.
SLIMTR — Stream-Lined Integration Module Test Register
$YFFA02
SLIMTRE — Stream-Lined Integration Module Test Register (E Clock)
$YFFA08
TSTMSRA — Master Shift Register A
$YFFA40
TSTMSRB — Master Shift Register B
$YFFA42
TSTSC — Test Module Shift Count
$YFFA44
TSTRC — Test Module Repetition Count
$YFFA46
CREG — Test Submodule Control Register
$YFFA48
DREG — Distributed Register
$YFFA4A
Table 46 IACK/CS Field
IACK/CS
Description
0
CSA not asserted with external IACK cycle
1
CSA asserted with external IACK cycle if IACK/CS in CSCR = 1
相关PDF资料 |
PDF描述 |
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参数描述 |
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