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参数资料
| 型号： | SPMC16V1CPU20 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 76/128页 |
| 文件大小： | 571K |
| 代理商： | SPMC16V1CPU20 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页当前第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MC68HC16V1
MOTOROLA
MC68HC16V1TS/D
51
The port C pin assignment register controls the function of all port C pins.
In expanded modes, the pin assignment register resets to the default reset states programmed in the
port/clock configuration shadow register (PCON[13:11]).
PC[1:0] can be configured as address pins (ADDR[17:16]) or digital I/O. Refer to Table 32.
3.8.3 Port D Operations
Port D pins can be individually selected as either digital I/O or external bus control and debug signals,
depending on the mode of the SLIM configured during reset.
The port D output data register latches the data to be driven on the port D output pins. When read,
PORTD always reflects the current state of the data latches. Power-on reset can change the state of
these latches. All other sources of reset have no effect.
When read, the port D pin data register reflects the current state of the port D pins, regardless of wheth-
er the pins are configured as inputs or outputs. Writes have no effect.
PCPAR — Port C Pin Assignment Register
$YFFA1E
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
NOT USED
PCPA[2:0]
PDPAR
RESET (EXPANDED MODE):
0
PCON
13
PCON
12
PCON
11
RESET (SINGLE-CHIP MODE):
0
Table 32 PC[1:0] Pin Assignment Encoding
PCPAR[10:8]
Port C I/O Pins
Address Pins
0 0 0
PC[1:0]
None
0 0 1
PC1
ADDR16
0 1 0
None
ADDR[17:16]
0 1 1
Reserved
1 X X
Reserved
PORTD — Port D Output Data Register
$YFFA19
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
PORTC
PD7
PD6
PD5
PD4
PD3
PD2
PD1
PD0
RESET:
U
PORTDP — Port D Pin Data Register
$YFFA1B
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
PORTC
PDP7
PDP6
PDP5
PDP4
PDP3
PDP2
PDP1
PDP0
RESET:
CURRENT STATE OF CORRESPONDING PINS
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