参数资料
| 型号： | ADP1046ACPZ-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 89/92页 |
| 文件大小： | 0K |
| 描述： | IC DGTL CTRLR 32LFCSP |
| 标准包装： | 5,000 |
| 应用： | 电源 |
| 输入电压： | 0 V ~ 1.6 V |
| 电源电压： | 3 V ~ 3.6 V |
| 电流 - 电源： | 20mA |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-WFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP-WQ（5x5） |
| 包装： | 带卷 (TR) |
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Data Sheet
Table 162. Register 0x49—OUTC Rising Edge Dead Time in Resonant Mode
ADP1046
Bits
[7:0]
Bit Name
Δt 5 (rising edge dead
time of OUTC)
R/W
R/W
Description
This register sets Δt 5 , which is the difference between the rising edge of OUTC and the mid-
point of the switching cycle, t B . Each LSB corresponds to 5 ns of resolution. When the register
value is from 0x00 to 0x7F, the rising edge of OUTC is trailing t B . When the value is from 0x80
to 0xFF, the rising edge of OUTC is leading t B .
Bit 7
0
0
…
0
1
…
1
Bit 6
0
0
…
1
0
…
1
Bit 5
0
0
…
1
0
…
1
Bit 4
0
0
…
1
0
…
1
Bit 3
0
0
…
1
0
…
1
Bit 2
0
0
…
1
0
…
1
Bit 1
0
0
…
1
0
…
1
Bit 0
0
1
…
1
0
…
1
Δt 5
0 ns
5 ns trailing
…
635 ns trailing
640 ns leading
…
5 ns leading
Table 163. Register 0x4A—Burst Mode Operation in Resonant Mode
Bits
[7:6]
[5:0]
Bit Name
Burst mode enable
Burst mode offset
R/W
R/W
R/W
Description
These bits are used to enable or disable burst mode operation.
Bit 7
Bit 6
Burst Mode
0
0
Disabled
0
1
Enabled for normal operation, but disabled during soft start
1
0
Disabled
1
1
Enabled for normal operation and during soft start
These bits, along with the highest switching frequency limit, determine the threshold value for
frequency limit set in Register 0x46.
Table 164. Register 0x4B—OUTC Falling Edge Dead Time in Resonant Mode
Bits
[7:0]
Bit Name
Δt 6 (falling edge dead
time of OUTC)
R/W
R/W
Description
This register sets Δt 6 , which is the leading time of the falling edge of OUTC from the end of the
switching cycle, t C . Each LSB corresponds to 5 ns of resolution.
Bit 7
0
0
…
1
Bit 6
0
0
…
1
Bit 5
0
0
…
1
Bit 4
0
0
…
1
Bit 3
0
0
…
1
Bit 2
0
0
…
1
Bit 1
0
0
…
1
Bit 0
0
1
…
1
Δt 6 (ns)
0
5
…
1275
Table 165. Register 0x4D—OUTD Rising Edge Dead Time in Resonant Mode
Bits
[7:0]
Bit Name
Δt 7 (rising edge dead
time of OUTD)
R/W
R/W
Description
This register sets Δt 7 , which is the difference between the rising edge of OUTD and the mid-
point of the switching cycle, t B . Each LSB corresponds to 5 ns of resolution. When the register
value is from 0x00 to 0x7F, the rising edge of OUTD is trailing t B . When the value is from 0x80
to 0xFF, the rising edge of OUTD is leading t B .
Bit 7
0
0
…
0
1
…
1
Bit 6
0
0
…
1
0
…
1
Bit 5
0
0
…
1
0
…
1
Bit 4
0
0
…
1
0
…
1
Bit 3
0
0
…
1
0
…
1
Bit 2
0
0
…
1
0
…
1
Bit 1
0
0
…
1
0
…
1
Bit 0
0
1
…
1
0
…
1
Δt 7
0 ns
5 ns trailing
…
635 ns trailing
640 ns leading
…
5 ns leading
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