参数资料
| 型号： | ADP1046ACPZ-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 90/92页 |
| 文件大小： | 0K |
| 描述： | IC DGTL CTRLR 32LFCSP |
| 标准包装： | 5,000 |
| 应用： | 电源 |
| 输入电压： | 0 V ~ 1.6 V |
| 电源电压： | 3 V ~ 3.6 V |
| 电流 - 电源： | 20mA |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-WFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP-WQ（5x5） |
| 包装： | 带卷 (TR) |
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ADP1046
Table 166. Register 0x4F—OUTD Falling Edge Dead Time in Resonant Mode
Data Sheet
Bits
[7:0]
Bit Name
Δt 8 (falling edge dead
time of OUTD)
R/W
R/W
Description
This register sets Δt 8 , which is the leading time of the falling edge of OUTD from the end of the
switching cycle, t C . Each LSB corresponds to 5 ns of resolution.
Bit 7
0
0
…
1
Bit 6
0
0
…
1
Bit 5
0
0
…
1
Bit 4
0
0
…
1
Bit 3
0
0
…
1
Bit 2
0
0
…
1
Bit 1
0
0
…
1
Bit 0
0
1
…
1
Δt 8 (ns)
0
5
…
1275
Table 167. Register 0x51—SR1 Rising Edge Dead Time in Resonant Mode
Bits
[7:0]
Bit Name
Δt 9 (rising edge dead
time of SR1)
R/W
R/W
Description
This register sets Δt 9 , which is the delay time of the rising edge of SR1 from the ACSNS rising
edge, t D . Each LSB corresponds to 5 ns of resolution.
Bit 7
0
0
…
1
Bit 6
0
0
…
1
Bit 5
0
0
…
1
Bit 4
0
0
…
1
Bit 3
0
0
…
1
Bit 2
0
0
…
1
Bit 1
0
0
…
1
Bit 0
0
1
…
1
Δt 9 (ns)
0
5
…
1275
Table 168. Register 0x53—SR1 Falling Edge Dead Time in Resonant Mode
Bits
[7:0]
Bit Name
Δt 10 (falling edge
dead time of SR1)
R/W
R/W
Description
This register sets Δt 10 , which is the leading time of the falling edge of SR1 from the ACSNS
falling edge, t E . Each LSB corresponds to 5 ns of resolution.
Bit 7
0
0
…
1
Bit 6
0
0
…
1
Bit 5
0
0
…
1
Bit 4
0
0
…
1
Bit 3
0
0
…
1
Bit 2
0
0
…
1
Bit 1
0
0
…
1
Bit 0
0
1
…
1
Δt 10 (ns)
0
5
…
1275
Table 169. Register 0x55—SR2 Rising Edge Dead Time in Resonant Mode
Bits
[7:0]
Bit Name
Δt 11 (rising edge dead
time of SR2)
R/W
R/W
Description
This register sets Δt 11 , which is the delay time of the rising edge of SR2 from the ACSNS falling
edge, t E . Each LSB corresponds to 5 ns of resolution.
Bit 7
0
0
…
1
Bit 6
0
0
…
1
Bit 5
0
0
…
1
Bit 4
0
0
…
1
Bit 3
0
0
…
1
Bit 2
0
0
…
1
Bit 1
0
0
…
1
Bit 0
0
1
…
1
Δt 11 (ns)
0
5
…
1275
Table 170. Register 0x57—SR2 Falling Edge Dead Time in Resonant Mode
Bits
[7:0]
Bit Name
Δt 12 (falling edge
dead time of SR2)
R/W
R/W
Description
This register sets Δt 12 , which is the leading time of the falling edge of SR2 from the ACSNS rising
edge, t F . Each LSB corresponds to 5 ns of resolution.
Bit 7
0
0
…
1
Bit 6
0
0
…
1
Bit 5
0
0
…
1
Bit 4
0
0
…
1
Bit 3
0
0
…
1
Bit 2
0
0
…
1
Bit 1
0
0
…
1
Bit 0
0
1
…
1
Δt 12 (ns)
0
5
…
1275
Rev. B | Page 90 of 92
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