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参数资料
| 型号： | GT-96100A |
| 厂商： | Galileo Technology Services, LLC |
| 英文描述： | Advanced Communication Controller That Handles a Wide Range of Serial Communication Protocols,such as Ethernet,Fast Ethernet,and HDLC(通信协议的高级通信协议（以太网、快速以太网、HDLC）控制器) |
| 中文描述： | 先进的通信控制器能够处理的串行通信协议，范围广，如以太网，快速以太网，和HDLC（通信协议的高级通信协议（以太网，快速以太网，HDLC的）控制器） |
| 文件页数： | 1/549页 |
| 文件大小： | 7321K |
| 代理商： | GT-96100A |
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Galileo
GT-96100A
Advanced Communication Controller
Datasheet
Revision 1.0
3 October, 2000
FEATURES
www.galileoT.com
support@galileoT.com
Please contact Galileo Technology for possible
updates before finalizing a design.
Integrated communication controller and
system controller with PCI interface for high-
performance embedded control applications.
Eight Multi-Protocol Serial Controllers
(MPSCs):
- Support HDLC, BISYNC, UART and
Transparent protocols.
- Bit rate of up to 55Mbit/s on multiple
channels simultaneously.
- Can drive dedicated pins or use
TDMs.
- Dedicated DPLL for clock recovery
and data encoding/decoding.
- Supports NRZ, NRZI, FM0, FM1,
Manchester and Differential
Manchester.
- Hardware support for HDLC over
asynchronous channel in UART
mode.
Four FlexTDM channels:
- Time slot assigner for serial and
control channels.
- Supports up to four Basic Rate ISDN
interfaces (2B+D) in GCI mode.
- Fully programmable via dual-port
memory.
Two 10/100Mbps Fast Ethernet MAC
controllers:
- MII/RMII interface.
- Full duplex and flow-control support.
- Programmable perfect filtering of 1/2K
or 8K MAC addresses (both physical
and multicast).
- 2 Queues for Tx Priority queueing
- 4 Queues for Priority queuing based
on IP DSCP field or 802.1q tag or
MAC address.
- IGMP and BPDU packet trapping.
Twenty Serial DMA (SDMA) channels to
support the communications and Ethernet
controllers.
- Moves data between communications
controllers and SDRAM/PCI.
- Buffer chaining via a linked list of
descriptors.
Eight baud rate generators with multiple clock
sources.
64-bit CPU bus interface:
- Supports all 64-bit bus MIPS CPUs:
RM5260, RM5270/1 and RM7000
from QED, RV4600 through RV5000
from IDT and R5000 compatibles from
various vendors.
- 100MHz bus frequency.
- 3.3V bus interface.
- Support for multiple GT-96100A
devices on the same SysAD bus (up
to 4).
- 8x64-bit (64 byte) CPU write posting
buffer accepts CPU writes with zero
wait-states.
- CPU address remapping to resources.
- Zero wait state secondary cache
support (L2 of R4xxx and R5000, L3
of R7000).
- Backward Software Compatibility with
GT-64010A, GT-64011 and GT-64120.
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