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参数资料
| 型号： | MC68330FC16 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 16.78 MHz, MICROPROCESSOR, PQFP132 |
| 封装： | PLASTIC, QFP-132 |
| 文件页数： | 226/261页 |
| 文件大小： | 1153K |
| 代理商： | MC68330FC16 |
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MOTOROLA
MC68330 USER’S MANUAL
3- 39
if bus requests are still pending after the negation of
BG, the MC68330 asserts another BG
within a few clock cycles after it was negated. This additional assertion of
BG allows
external arbitration circuitry to select the next bus master before the current bus master
has finished using the bus. The following paragraphs provide additional information about
the three steps in the arbitration process. Bus arbitration requests are recognized during
normal processing,
HALT assertion, and when the CPU32 has halted due to a double bus
fault.
GRANT BUS ARBITRATI
1. ASSERT B
TERMINATE ARBITRATI
1. NEGATE BG (AND WAIT
BGACK TO BE NEGAT
RE-ARBITRATE OR RESUME
PROCESSOR OPERATION
PROCESSOR
REQUESTING DEVIC
REQUEST THE BUS
1. ASSERT B
ACKNOWLEDGE BUS MASTERSHIP
1. EXTERNAL ARBITRATION DETERMINES
NEXT BUS MASTER
2. NEXT BUS MASTER WAITS FOR BGAC
TO BE NEGATED
3. NEXT BUS MASTER ASSERTS BGACK
TO BECOME NEW MASTER
4. BUS MASTER NEGATES BR
OPERATE AS BUS MASTER
RELEASE BUS MASTERSHIP
1. NEGATE BGA
1. PERFORM DATA TRANSFERS (REA
WRITE CYCLES) ACCORDING TO TH
SAME RULES THE PROCESSOR USE
Figure 3-22. Bus Arbitration Flowchart for Single Request
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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