参数资料
型号: MC68330FC16
厂商: MOTOROLA INC
元件分类: 微控制器/微处理器
英文描述: 32-BIT, 16.78 MHz, MICROPROCESSOR, PQFP132
封装: PLASTIC, QFP-132
文件页数: 234/261页
文件大小: 1153K
代理商: MC68330FC16
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3- 46
MC68330 USER’S MANUAL
MOTOROLA
Figure 3-27. Timing for External Devices Driving
RESET
If reset is asserted from any other source, the reset control logic asserts
RESET for a
minimum of 512 cycles, and until the source of reset is negated.
After any internal reset occurs, a 14-cycle rise time is allowed before testing for the
presence of an external reset. If no external reset is detected, the CPU32 begins its vector
fetch.
Figure 3-28 is a timing diagram of the power-up reset operation, showing the relationships
between
RESET, VCC, and bus signals. During the reset period, the entire bus three-
states (except for non-three-statable signals, which are driven to their inactive state). Once
RESET negates, all control signals are driven to their inactive state, the data bus is in read
mode, and the address bus is driven. After this, the first bus cycle for
RESET exception
processing begins.
CLKOUT
VCO
LOCK
BUS
CYCLES
RESET
VCC
12
3
4
BUS STATE
UNKNOWN
ADDRESS AND
CONTROL SIGNAL
THREE-STATED
512 CLOCKS
NOTES:
1. Internal start-up time.
2. SSP read here.
3. PC read here.
4. First instruction fetched here.
14 CLOCKS
Figure 3-27. Initial Reset Operation Timing
When a reset instruction is executed, the MC68330 drives the
RESET signal for 512 clock
cycles. In this case, the MC68330 resets the external devices of the system, and the
internal registers of the MC68330 are unaffected.
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