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参数资料
| 型号： | M-ORSO82G51BM680-DB |
| 厂商： | LATTICE SEMICONDUCTOR CORP |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 1296 CLBS, 333000 GATES, PBGA680 |
| 封装： | PLASTIC, FBGA-680 |
| 文件页数： | 93/123页 |
| 文件大小： | 2207K |
| 代理商： | M-ORSO82G51BM680-DB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页当前第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页
Lattice Semiconductor
ORCA ORSO82G5 Data Sheet
71
Table 17. SERDES Common Conguration Register Descriptions
(0x) Abso-
lute
Address
Bit
Name
Reset
Value
(0x)
Description
Mode
SERDES Common Transmit and Receive Channel Conguration Registers (Read/Write) xx = [AA, ...,BD]
30004 - AA
30014 -AB
30024 - AC
30034 - AD
30104 - BA
30114 - BB
30124 - BC
30134 - BD
[0]
RSVD
40
Reserved
[1]
MASK_xx
Transmit and Receive Alarm Mask Bit, Channel
xx. When MASK_xx = 1, the transmit and receive
alarms of a channel are prevented from generat-
ing an alarm (i.e., they are masked or disabled).
The MASK_xx bit overrides the individual alarm
mask bits in the Alarm Mask Registers.
MASK_xx = 1 on device reset.
Both
[2]
SWRST_xx
Transmit and Receive Software Reset Bit, Chan-
nel xx. When SWRST_xx = 1, this bit provides the
same function as the hardware reset, except that
all conguration register settings are unaltered.
This is not a self-clearing bit. Once set, this bit
must be manually set and cleared.
SWRST = 0 on device reset.
Both
[3:6]
RSVD
Reserved
[7]
TESTEN_xx
Transmit and Receive Test Enable Bit, Channel
xx. When TESTEN_xx = 1, the transmit and
receive sections are placed in test mode. The
TestMode_[A:B][4:0] bits (0x3006, 0x30106)
specify the particular test, and must also be set.
NOTE: When the global test enable bit
GTESTEN_[A:B] = 0, the individual channel test
enable bits are used to selectively place a chan-
nel in test or normal mode. When
GTESTEN_[A:B] = 1, all channels are set to test
mode regardless of their TESTEN setting
TESTEN_xx = 0 on device reset.
Both
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PDF描述 |
|---|---|
| M-ORSO82G52BM680-DB | FPGA, 1296 CLBS, 333000 GATES, PBGA680 |
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| M.PI-1R1D12 | 1 ELEMENT, 1.1 uH, GENERAL PURPOSE INDUCTOR, SMD |
| M01-014-1452PA | 14 CONTACT(S), MALE, RIGHT ANGLE TELECOM AND DATACOM CONNECTOR, SOLDER |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MORTAR-44LB | 制造商:3M Electronic Products Division 功能描述:3M(TM) FIRE BARRIER MORTAR, 44 98040056073 制造商:3M Electronic Products Division 功能描述:Fire Barrier 44 lb Bag |
| MO-RX3930 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FSK RECEIVER MODULE |
| MO-RX3930-FS | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FSK RECEIVER MODULE |
| MO-RX3930-FS315M | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FSK RECEIVER MODULE |
| MO-RX3930-FS434M | 制造商:未知厂家 制造商全称:未知厂家 功能描述:FSK RECEIVER MODULE |
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