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参数资料
| 型号： | W631GG6KB-15 |
| 厂商： | Winbond Electronics |
| 文件页数： | 103/159页 |
| 文件大小： | 0K |
| 描述： | IC DDR3 SDRAM 1GBIT 96WBGA |
| 标准包装： | 200 |
| 格式 - 存储器： | RAM |
| 存储器类型： | DDR3 SDRAM |
| 存储容量： | 1G（64M x 16） |
| 速度： | 667MHz |
| 接口： | 并联 |
| 电源电压： | 1.425 V ~ 1.575 V |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 96-TFBGA |
| 供应商设备封装： | 96-WBGA（9x13） |
| 包装： | 托盘 |
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W631GG6KB
10.6.3 Differential swing requirements for clock (CK - CK#) and strobe (DQS - DQS#)
Table 19 – Differential DC and AC Input Level
PARAMETER
SYMBOL
DDR3-1333, DDR3-1600 & DDR3-1866
MIN. MAX.
UNIT
NOTES
Differential input high
Differential input low
Differential input high AC
Differential input low AC
V IHDIFF
V ILDIFF
V IHDIFF(AC)
V ILDIFF(AC)
+0.200
Note 3
2 x (V IH(AC) - V REF )
Note 3
Note 3
-0.200
Note 3
2 x (V IL(AC) - V REF )
V
V
V
V
1
1
2
2
Notes:
1. Used to define a differential signal slew-rate.
2. For CK - CK# use V IH.CA(AC) /V IL.CA(AC) of ADD/CMD and V REFCA ; for DQSL, DQSL#, DQSU , DQSU# use
V IH.DQ(AC) /V IL.DQ(AC) of DQs and V REFDQ ; if a reduced AC-high or AC-low level is used for a signal group, then the
reduced level applies also here.
3. These values are not defined; however, the single-ended signals CK, CK#, DQSL, DQSL#, DQSU, DQSU# need to be within
the respective limits (V IH(DC) max, V IL(DC)min ) for single-ended signals as well as the limitations for overshoot and
undershoot. Refer to section 10.12 “ Overshoot and Undershoot Specifications ” on page 121.
t DVAC
V IHDIFF(AC)min
V IHDIFFmin
0
Half cycle
V ILDIFFmax
V ILDIFF(AC)max
t DVAC
time
Figure 90 – Definition of differential ac- swing and “time above AC- level” t DVAC
Publication Release Date: Dec. 09, 2013
Revision A05
- 103 -
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PDF描述 |
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参数描述 |
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| W632GG6KB-11 | 制造商:Winbond Electronics Corp 功能描述:IC DDR3 SDRAM 2GBIT 96WBGA |
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