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参数资料
| 型号： | W631GG6KB-15 |
| 厂商： | Winbond Electronics |
| 文件页数： | 133/159页 |
| 文件大小： | 0K |
| 描述： | IC DDR3 SDRAM 1GBIT 96WBGA |
| 标准包装： | 200 |
| 格式 - 存储器： | RAM |
| 存储器类型： | DDR3 SDRAM |
| 存储容量： | 1G（64M x 16） |
| 速度： | 667MHz |
| 接口： | 并联 |
| 电源电压： | 1.425 V ~ 1.575 V |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 96-TFBGA |
| 供应商设备封装： | 96-WBGA（9x13） |
| 包装： | 托盘 |
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t CK ( avg ) = ? ? tCK j ? / N
W631GG6KB
10.14 Clock Specification
The jitter specified is a random jitter meeting a Gaussian distribution. Input clocks violating the
min/max values may result in malfunction of the DDR3 SDRAM device.
Definition for tCK(avg)
t CK(avg) is calculated as the average clock period across any consecutive 200 cycle window, where
each clock period is calculated from rising edge to rising edge.
? N ?
? j ? 1 ?
where
N = 200
t CH ( avg ) = ? ? tCH j ? / ( N × t CK ( avg ))
Definition for tCK(abs)
t CK(abs) is defined as the absolute clock period, as measured from one rising edge to the next
consecutive rising edge. t CK(abs) is not subject to production test.
Definition for tCH(avg) and tCL(avg)
t CH(avg) is defined as the average high pulse width, as calculated across any consecutive 200 high
pulses.
? N ?
? j ? 1 ?
where
N = 200
t CL ( avg ) = ? ? tCL j ? / ( N × t CK ( avg ))
t CL(avg) is defined as the average low pulse width, as calculated across any consecutive 200 low
pulses.
? N ?
? j ? 1 ?
where
N = 200
Definition for tJIT(per) and tJIT(per,lck)
t JIT(per) is defined as the largest deviation of any signal t CK from t CK(avg) .
t JIT(per) = Min/max of {t CK i - t CK(avg) where i = 1 to 200}.
t JIT(per) defines the single period jitter when the DLL is already locked.
t JIT(per,lck) uses the same definition for single period jitter, during the DLL locking period only.
t JIT(per) and t JIT(per,lck) are not subject to production test.
Publication Release Date: Dec. 09, 2013
Revision A05
- 133 -
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