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参数资料
| 型号： | DS34S132GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 124/194页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 电路数： | 1 |
| 电源电压： | 1.8V, 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 676-BGA |
| 供应商设备封装： | 676-PBGA（27x27） |
| 包装： | 管件 |
| 其它名称： | 90-34S13+2N0 |
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
35 of 194
9.2.1.2 TDM Port - One Clock and Two Clock Modes
Each TDM Port can be independently programmed to support “One Clock” or “Two Clock” operation. In the “One
Clock” mode, the transmit and receive directions are both timed relative to either TCLKOn for TDM Ports that have
line rates that are synchronized to a local system clock (System Timed) or relative to RCLKn for TDM Ports that are
programmed to be “Loop Timed”.
In the “Two Clock” mode RCLK is used to time receive data and TCLKO is used to time transmit data allowing the
line rates and/or clock phases of the TXP and RXP directions to be different. This supports the most generalized
case for asynchronous transmit and receive timing. Table 9-1 identifies how to select between these modes.
Table 9-1. One-Clock and Two-Clock Mode settings
Mode
Pn.PTCR2.TSS
Pn.PRCR2.RSS
One Clock Mode using RCLK (Loop Timed)
0
One Clock Mode using TCLKO (System Timed)
1, 2, 4 or 5
1
Two Clock Mode (independent receive and transmit timing)
1, 2, 4 or 5
0
9.2.2 TDM Port Interface
Each TDM Port supports independent transmit and receive NRZ data, clock, sync pulse and signaling pins. Figure
9-10 provides a high level view of the interconnections to TDM Port “n”.
Figure 9-10. TDM Port #1 Environment
DS34S132
RDATn, RSIGn,
RSYNCn, RCLKn
TDATn, TSIGn,
TSYNCn, TCLKOn
T1/E1
LIU &
Framer
TDM Rcv
Port n
TDM Xmt
Port n
TXP
TSA
RXP
TSA
EXTCLK0
EXTCLK1
grclk
aclk_n
Global Clock Recovery Select
Port n Clock
Recovery Engine
TCLKOn
RCLKn
TCLKOn
RCLKn
Port 31 Ck Recov Engine
Port 0 Ck Recov Engine
When configured for Structured (CES), the RSYNCn/TSYNCn signals are used to identify the T1/E1 frame
synchronization, CAS and Timeslot positions. For Unstructured (SAT), the RSYNCn/TSYNCn signals are ignored
and the entire TDM Port bandwidth is transported in the TDM-over-Packet payload without regard to framing.
The TSYNC and RSYNC signals can be programmed to be input or output signals, although they are portrayed in
this diagram as unidirectional. Figure 9-11 provides a more detailed view of the TDM Port Interface.
相关PDF资料 |
PDF描述 |
|---|---|
| DS34T102GN+ | IC TDM OVER PACKET 484TEBGA |
| DS3501U+H | IC POT NV 128POS HV 10-USOP |
| DS3502U+ | IC POT DGTL NV 128TAP 10-MSOP |
| DS3503U+ | IC POT DGTL NV 128TAP 10-MSOP |
| DS3897MX | IC TXRX BTL TRAPEZIODAL 20-SOIC |
相关代理商/技术参数 |
参数描述 |
|---|---|
| DS34S132GN+ | 功能描述:通信集成电路 - 若干 32Port TDM-Over-Pack Transport Device RoHS:否 制造商:Maxim Integrated 类型:Transport Devices 封装 / 箱体:TECSBGA-256 数据速率:100 Mbps 电源电压-最大:1.89 V, 3.465 V 电源电压-最小:1.71 V, 3.135 V 电源电流:50 mA, 225 mA 最大工作温度:+ 85 C 最小工作温度:- 40 C 封装:Tube |
| DS34S132GNA2+ | 功能描述:通信集成电路 - 若干 32Port TDM-Over-Pack Transport Device RoHS:否 制造商:Maxim Integrated 类型:Transport Devices 封装 / 箱体:TECSBGA-256 数据速率:100 Mbps 电源电压-最大:1.89 V, 3.465 V 电源电压-最小:1.71 V, 3.135 V 电源电流:50 mA, 225 mA 最大工作温度:+ 85 C 最小工作温度:- 40 C 封装:Tube |
| DS34T101 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_08 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_09 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
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