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参数资料
| 型号： | DS34S132GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 7/194页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 电路数： | 1 |
| 电源电压： | 1.8V, 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 676-BGA |
| 供应商设备封装： | 676-PBGA（27x27） |
| 包装： | 管件 |
| 其它名称： | 90-34S13+2N0 |
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
104 of 194
10.3.3 Jitter Buffer Registers (JB.)
10.3.3.1 Jitter Buffer Status Registers (JB.)
Table 10-11. Jitter Buffer Status Registers (JB.)
JB. Field
Name
Addr (A:)
Bit [x:y] Type
Description
G0SRL.
A:0200h
Group 0 Status Register Latch.
RSVD
[31:8]
Reserved.
JBU [7:0]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer Underrun or “Start of Playout” according
to the G.GCR.IPSE setting. Bits [7:0] indicate Bundles [7:0] respectively.
G1SRL.
A:0204h
Group 1 Status Register Latch.
RSVD
[31:8]
Reserved.
JBU
[15:8]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[15:8] respectively. This can also optionally indicate the start of playout.
G2SRL.
A:0208h
Group 2 Status Register Latch.
RSVD
[31:8]
Reserved.
JBU
[23:16]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[23:16] respectively. This can also optionally indicate the start of playout.
G3SRL.
A:020Ch
Group 3 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[31:24]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[31:24] respectively. This can also optionally indicate the start of playout.
G4SRL.
A:0210h
Group 4 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[39:32]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[39:32] respectively. This can also optionally indicate the start of playout.
G5SRL.
A:0214h
Group 5 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[47:40]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[47:40] respectively. This can also optionally indicate the start of playout.
G6SRL.
A:0218h
Group 6 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[55:48]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[55:48] respectively. This can also optionally indicate the start of playout.
G7SRL.
A:021Ch
Group 7 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[63:56]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[63:56] respectively. This can also optionally indicate the start of playout.
G8SRL.
A:0220h
Group 8 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[71:64]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[71:64] respectively. This can also optionally indicate the start of playout.
G9SRL.
A:0224h
Group 9 Status Register Latch. Default: 0x00.00.00.00
RSVD
[31:8]
Reserved.
JBU
[79:72]
[7:0] rls-cor-i3
Jitter Buffer Underrun “1” = Jitter Buffer underrun. Bits [7:0] indicate Bundles
[79:72] respectively. This can also optionally indicate the start of playout.
相关PDF资料 |
PDF描述 |
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参数描述 |
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| DS34T101_08 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_09 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
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