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参数资料
| 型号： | DS34S132GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 186/194页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 电路数： | 1 |
| 电源电压： | 1.8V, 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 676-BGA |
| 供应商设备封装： | 676-PBGA（27x27） |
| 包装： | 管件 |
| 其它名称： | 90-34S13+2N0 |
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DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
91 of 194
B. Field
Name
Addr (A:)
Bit [x:y] Type
Description
BDSCR. A:00A0h
RXP Bundle Decap Status Control Register. Default: 0x00.00.00.00
RSVD
[31:11]
Reserved.
DSRE
[10] rwc-_-_
Decap Status Read Enable, on a transition from zero to one, loads B.BDSR1 –
B.BDSR9 with values from the Bundle selected by B.BDSCR.DSBS. The
B.BDSR1 - B.BDSR9 read operations may take more than one CPU access time,
so the CPU should perform a no-op before reading the BDSRx values.
RSVD
[9:8] rwc-_-_
Reserved.
DSBS
[7:0] rwc-_-_
Decap Status Bundle Select selects the Bundle Number (0 – 255) that is used
when accessing the B.BDSR1 – B.BDSR9 registers.
10.3.2.3 Bundle Data Registers (B.)
Table 10-8. Bundle Data Registers (B.)
B. Field
Name
Addr (A:)
Bit [x:y] Type
Description
BADR1.
A:00A4h
Bundle Activation Data Register 1. Default: 0x00.00.00.00
RSVD
[31:1]
Reserved.
ABE
[0] rwd-_-_
Active Bundle Enable = “1” indicates the RXP Bundle selected by B.BACR is
enabled. When “0” the RXP Bundle is disabled/ignored. This bit does not affect
the Bundle’s TXP direction. The chip reset functions disable all 256 Bundles
(G.GRCR.RST and RST_N pin).
BADR2.
A:00A8h
Bundle Activation Data Register 2. Default: 0x00.00.00.00
BIDV
[31:0] rwd-_-_
Bundle ID Value is the BID or OAM BID value for the Bundle Number or OAM
Bundle Number selected by B.BACR. The bit width of BIDV varies as indicated
below. When BIDV bit width <32, the unused MSbits of the BIDV must be “0”.
32 bits - L2TPv3 and UDP when 32-bit width is selected by PC.PCCR1.UBIDLS
20 bits - MPLS and MEF
16 bits - UDP when 16-bit width is selected by PC.PCCR1.UBIDLS
BCDR1. A:00ACh
Bundle Configuration Data Register 1. Default: 0x00.00.00.00
RSVD
[31:24]
Reserved.
LBCAI
[23] rwd-_-_
L Bit Conditioning Auto Insert determines how the RXP packet payload is
handled when L-bit = 1. This setting does not affect the Clock Recovery functions
or the Jumped Packet Count.
0 = L-bit is ignored, payload is processed normally (no special handling).
1 = Discard RXP packet payload (if it exists).
Note: If LBCAI = 1 and L-bit = 1, the packet is not counted as lost.
PMT
[22:21] rwd-_-_
Payload Machine Type.
0 = HDLC Payload Machine Type
1 = Reserved
2 = Reserved
3 = SAT/CES Machine Type
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PDF描述 |
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