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参数资料
型号： DS34S132GN+
厂商： Maxim Integrated Products
文件页数： 80/194页
文件大小： 0K
描述： IC TDM OVER PACKET 676-BGA
产品培训模块： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
标准包装： 40
功能： TDM-over-Packet（TDMoP）
接口： TDMoP
电路数： 1
电源电压： 1.8V, 3.3V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 676-BGA
供应商设备封装： 676-PBGA（27x27）
包装： 管件
其它名称： 90-34S13+2N0
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页当前第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页
DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
170 of 194
1 ms
256
500
985
1300
1912
3612
6502
10837
128
248
489
645
949
1792
3226
5376
64
122
240
317
467
882
1587
2645
32
59
116
154
226
427
768
1280
5 ms
256
507
1010
1345
2007
3965
7742
14780
128
252
502
667
997
1967
3842
7332
64
125
247
330
490
970
1890
3607
32
60
120
160
237
470
915
1747
10 ms
256
INVALID
1015
1350
2020
4015
7930
15485
128
INVALID
505
670
1005
1995
3935
7685
64
INVALID
250
330
495
980
1940
3780
32
INVALID
120
160
240
475
940
1830
Note: “INVALID” means that the packet size would exceed the 2 Kbyte maximum packet size.
It is expected that a 256 Mbit DDR SDRAM will support most applications. With a 256 Mbit device and a JBMD
setting of 64 KByte, the system can support up to 110 ms of PDV on any combination of Bundle sizes (1 Timeslot
to 32 Timeslots per Bundle). The Packet Creation Time (PCT) and BFD can be set to any valid values. To minimize
the S132 process latency the BFD can be set to a 1 frame period. Larger SDRAM devices can be used to support
this same application description (e.g. if pricing or availability makes a larger device more desirable). If the
maximum PDV can be decreased, for example to 53 ms then the smaller 128 Mbit could be used.
The SDRAM size selection can be complicated because there are so many variables. One approach is to begin by
knowing the maximum PDV and the maximum number of Timeslots in a Bundle. With this information Table 10-72
indicates the minimum JBMD. The SDRAM size can then be calculated from:
DDR SDRAM size = (JBMD in Kbytes) * # Bundles + total memory for other queues (e.g. TXP CPU queue)
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PDF描述
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