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参数资料
| 型号： | DS34S132GN+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 154/194页 |
| 文件大小： | 0K |
| 描述： | IC TDM OVER PACKET 676-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 40 |
| 功能： | TDM-over-Packet（TDMoP） |
| 接口： | TDMoP |
| 电路数： | 1 |
| 电源电压： | 1.8V, 3.3V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 676-BGA |
| 供应商设备封装： | 676-PBGA（27x27） |
| 包装： | 管件 |
| 其它名称： | 90-34S13+2N0 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页当前第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页
DS34S132 DATA SHEET
19-4750; Rev 1; 07/11
62 of 194
9.3.3.1 TXP SAT/CES/HDLC/Clock Only PW Packet Generation
A TXP Header Descriptor is programmed for each activated SAT, CES, HDLC and Clock Only Bundle (up to 256).
The TXP Header Descriptors are retrieved from memory as they are needed for each outgoing TXP PW Packet.
Figure 9-25 depicts the format of the data that is programmed in the TXP Header Descriptor. The Header Control is
used to identify the number of bytes included in the transmitted TXP Header and where the TXP Local Timestamp,
Length and FCS fields are located in the header so that the S132 can modify these fields “on-the-fly” when
required. The Header Control field values are not included in the transmitted Ethernet packets.
Figure 9-25. SAT/CES/HDLC/Clock Only PW TXP Header Descriptor
3
1
3
0
2
9
2
8
2
7
2
6
2
5
2
4
2
3
2
1
2
0
1
9
1
8
1
7
1
6
1
5
1
4
1
3
1
2
1
0 9 8 7 6 5 4 3 2 1 0
Header Control
2-bytes of Dummy Fill = 0x00.00
Ethernet Header including …
… DA, SA, optional VLAN Tags, optional LLC/SNAP and Type/Length fields
Application Protocol Header (e.g. UDP/IP, L2TPv3/IP, MFA-8, MEF-8)
Optional RTP and Control Word Headers
The 256 TXP Header Descriptors are programmed in an SDRAM memory block that begins at address
EMI.BMCR1.TXHSO. The TXP Header Descriptor for each Bundle is stored in a 128-byte SDRAM slot that is
addressed/indexed at the location = TXHXSO + (Bundle Number * 128 bytes).
The TXP Header Control for SAT/CES and HDLC PW packets is a 32-bit Dword (depicted in Table 9-11.
Table 9-11. TXP SAT/CES/HDLC/Clock Only PW Header Control
Field
Bit [x:y] Description
RSVD
[31:26]
Reserved.
TXELEN [25:21]
TXP Header Length specifies how many Dwords are in the packet header including the
Ethernet, Application, RTP and Control Word Headers (when applicable).
TXCWE [20]
TXP Control Word Exists. 1 = included; 0 = not included.
TXRE
[19]
TXP RTP Exists. 1 = included; 0 = not included.
RSVD
[18:16]
Reserved.
TXALEN [15:11]
TXP Application Header Length specifies how many Dwords are included in the
Application Protocol Header beginning just after the Ethernet Header and including the
Control Word and RTP Headers (when applicable).
TXAOFF [10:6]
TXP Application Header Offset = Dword offset of Application Header in Ethernet packet.
TXAOFF = (“Application Header starting byte position in Ethernet packet” - 2) ÷ 4
TXUDPE [5]
TXP UDP Header Exists. 1 = included; 0 = not included.
TXIPV6E [4]
TXP IPv6 Header Exists. 1 = included; 0 = not included.
TXIPV4E [3]
TXP IPv4 Header Exists. 1 = included; 0 = not included.
TXVLTC [2:1]
TXP VLAN Tag Count specifies # VLAN tags in the header (valid values = 0, 1 or 2).
TXETHF [0]
TXP Ethernet Header Format. 0 = DIX/Ethernet II format; 1 = IEEE 802.2 LLC/SNAP.
The S132 automatically generates TXP SAT/CES/Clock Only packets when sufficient data has been received from
the TDM Port to satisfy the B.BCDR1.PMS (effective payload size) and B.BCDR3.TXBTS (payload type) settings.
All SAT/CES/Clock Only Bundles must be assigned at least one Timeslot (B.BCDR2.ATSS and TSAn.m).
B.BCDR3.TXPMS selects whether the packet stream for the TXP Bundle is disabled, transmitted without payload
(Clock Only) or transmitted with payload (normal).
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PDF描述 |
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参数描述 |
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| DS34S132GNA2+ | 功能描述:通信集成电路 - 若干 32Port TDM-Over-Pack Transport Device RoHS:否 制造商:Maxim Integrated 类型:Transport Devices 封装 / 箱体:TECSBGA-256 数据速率:100 Mbps 电源电压-最大:1.89 V, 3.465 V 电源电压-最小:1.71 V, 3.135 V 电源电流:50 mA, 225 mA 最大工作温度:+ 85 C 最小工作温度:- 40 C 封装:Tube |
| DS34T101 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_08 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
| DS34T101_09 | 制造商:MAXIM 制造商全称:Maxim Integrated Products 功能描述:Single/Dual/Quad/Octal TDM-over-Packet Chip |
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